SDRAM读写控制的实现与Modelsim仿真 - 免费下载

VHDL/Verilog/EDA源码资源 文件大小:2121 K

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资源简介

软件开发环境:ISE 7.1i 硬件开发环境:红色飓风II代-Xilinx版 1. 本实例用于控制开发板上面的SDRAM完成读写功能; 先向SDRAM里面写数据,然后再将数据读出来做比较,如果不匹配就通过LED变亮显示出来,如果一致,LED就不亮。 2. part1目录是使用Modelsim仿真的工程; 3. part2目录是在开发版上面验证的工程; 2.1. part1_32目录是4m32SDRAM的仿真工程; 2.2. part1_16目录是4m16SDRAM的仿真工程; \model文件夹里面是仿真模型; \rtl文件夹里面是源文件; \sim文件夹里面是仿真工程; \test_bench文件夹里面是测试文件; \wave文件夹里面是仿真波形。 3.1. 工程在\project文件夹里面; 3.2. 源文件和管脚分配在\rtl文件夹里面; 3.3. 下载文件在\download文件夹里面,.mcs为PROM模式下载文件,.bit为JTAG调试下载文件。

源码文件列表

📂 共 170 个源码文件 点击文件名可在线查看源代码

2 📄
test.mcs
大小: 64 KB
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4 📄
test.ucf
大小: 1.75 KB
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5 📄
testtry.v
大小: 8.15 KB
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6 📄
page_wr.v
大小: 6.77 KB
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7 📄
burst_wr.v
大小: 8.15 KB
查看源码
8 📃
test_pad.txt
大小: 41.02 KB
查看源码
9 📄
test.drc
大小: 38 B
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10 📄
test.pad_txt
大小: 41.02 KB
查看源码
13 📄
test.xpi
大小: 46 B
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14 📄
test.ucf
大小: 1.75 KB
查看源码
15 📄
test.cmd_log
大小: 4.22 KB
查看源码
💡
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