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VHDL/FPGA/Verilog
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这份是实验课上的教师和学生用的实例。关于用matlab si
这份是实验课上的教师和学生用的实例。关于用matlab simulink仿真状态机并生成vhdl代码的详细内容
VHDL/FPGA/Verilog
947 K
90 次下载
2017-01-10
资源详细信息
文件格式
压缩包
文件大小
947 K
资源分类
VHDL/FPGA/Verilog
上传者
add505
发布时间
2017-01-10 10:18
下载统计
90
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2 积分
这份是实验课上的教师和学生用的实例。关于用matlab simulink仿真状态机并生成vhdl代码的详细内容 - 资源详细说明
这份是实验课上的教师和学生用的实例。关于用matlab simulink仿真状态机并生成vhdl代码的详细内容
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本资源包含 83 个源码文件
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1
c2_myuart1.h
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2
myuart1_sfun_registry.c
查看源码
3
myuart1_sfun.h
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4
myuart1_sfun.lmk
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5
myuart1_sfun.bat
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6
myuart1_sfun.lmko
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7
myuart1_sfun_debug_macros.h
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8
myuart1_sfun.c
查看源码
9
c2_myuart1.c
查看源码
10
c1_myuart1.h
查看源码
11
myuart1_sfun.exp
查看源码
12
c1_myuart1.c
查看源码
13
c2_myuart1.h
查看源码
14
myuart1_sfun_registry.c
查看源码
15
myuart1_sfun.h
查看源码
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