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系统设计方案
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利用verilog语言
利用verilog语言
系统设计方案
15 K
52 次下载
2016-12-29
资源详细信息
文件格式
RAR
文件大小
15 K
资源分类
系统设计方案
上传者
whyzhao
发布时间
2016-12-29 10:45
下载统计
52
次
所需积分
2 积分
利用verilog语言 - 资源详细说明
利用verilog语言,从上至下层次管理的设计思想;Verilog HDL的行为描述和结构描述,实现8位频率计,4个0检测修正电路的原理说明
利用verilog语言 - 源码文件列表
本资源包含 4 个源码文件
支持在线预览,点击文件名即可查看
1
频率计latch_16.v
查看源码
2
给定4个0的修正.ppt
查看源码
3
fre_ctrl.v
查看源码
4
频率计count10.v
查看源码
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