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VHDL/FPGA/Verilog
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这是一个卷积器的设计
这是一个卷积器的设计
VHDL/FPGA/Verilog
20 K
88 次下载
2013-12-20
资源详细信息
文件格式
RAR
文件大小
20 K
资源分类
VHDL/FPGA/Verilog
上传者
pangyi
发布时间
2013-12-20 17:58
下载统计
88
次
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2 积分
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这是一个卷积器的设计,源码值得好好地学习
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1
卷积器.doc
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