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VHDL/FPGA/Verilog
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这是我课程设计做的数字频率计的设计
这是我课程设计做的数字频率计的设计
VHDL/FPGA/Verilog
296 K
199 次下载
2013-11-25
资源详细信息
文件格式
RAR
文件大小
296 K
资源分类
VHDL/FPGA/Verilog
上传者
zhangtaoai007
发布时间
2013-11-25 18:13
下载统计
199
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这是我课程设计做的数字频率计的设计 - 资源详细说明
这是我课程设计做的数字频率计的设计,不知道会不会太简单或者重复了。
这是我课程设计做的数字频率计的设计 - 源码文件列表
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1
reg32b.acf
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2
control.pof
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3
count10(4).cnf
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4
control.sof
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5
reg32b.sym
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6
frq(11).cnf
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7
u5286660.dls
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8
count10.hif
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9
count10.sym
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10
count10(5).cnf
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11
reg32b.hex
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12
u9329429.dls
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13
count10(3).cnf
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14
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15
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