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利用verilog硬件描述语言编写的8为并行输入的常crc校
利用verilog硬件描述语言编写的8为并行输入的常crc校验模块。hdlc子模块
微处理器开发
2 K
33 次下载
2016-05-10
资源详细信息
文件格式
RAR
文件大小
2 K
资源分类
微处理器开发
上传者
zhuxiaobei123
发布时间
2016-05-10 00:08
下载统计
33
次
所需积分
2 积分
利用verilog硬件描述语言编写的8为并行输入的常crc校验模块。hdlc子模块 - 资源详细说明
利用verilog硬件描述语言编写的8为并行输入的常crc校验模块。hdlc子模块
利用verilog硬件描述语言编写的8为并行输入的常crc校验模块。hdlc子模块 - 源码文件列表
本资源包含 1 个源码文件
支持在线预览,点击文件名即可查看
1
crc16_8bit.v.txt
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