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用veriolg写的数字钟实验
用veriolg写的数字钟实验
VHDL/FPGA/Verilog
1160 K
118 次下载
2014-01-06
资源详细信息
文件格式
RAR
文件大小
1160 K
资源分类
VHDL/FPGA/Verilog
上传者
granite518
发布时间
2014-01-06 00:17
下载统计
118
次
所需积分
2 积分
用veriolg写的数字钟实验 - 资源详细说明
用veriolg写的数字钟实验,具有定点报时,闰年判断,年月日显示,下载平台为spantan3s400。有详细注解。适合verilog学习
用veriolg写的数字钟实验 - 源码文件列表
本资源包含 1 个源码文件
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1
ntrc.scr
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