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VHDL/FPGA/Verilog
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此程序为串行通信程序,采用verilog语言编写的,经过仿真
此程序为串行通信程序,采用verilog语言编写的,经过仿真验证已经通过.
VHDL/FPGA/Verilog
759 K
99 次下载
2013-12-23
资源详细信息
文件格式
RAR
文件大小
759 K
资源分类
VHDL/FPGA/Verilog
上传者
yhw002
发布时间
2013-12-23 12:10
下载统计
99
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2 积分
此程序为串行通信程序,采用verilog语言编写的,经过仿真验证已经通过. - 资源详细说明
此程序为串行通信程序,采用verilog语言编写的,经过仿真验证已经通过.
此程序为串行通信程序,采用verilog语言编写的,经过仿真验证已经通过. - 源码文件列表
本资源包含 100 个源码文件
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1
uart_regs.sim.rpt
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2
uart_regs.map.summary
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3
sim.cfg
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4
uart_regs_assignment_defaults.qdf
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5
uart_regs.qsf
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6
uart_regs.asm.rpt
查看源码
7
uart_regs.tan.rpt
查看源码
8
uart_regs.pof
查看源码
9
uart_regs.dpf
查看源码
10
uart_regs.qws
查看源码
11
uart_regs.flow.rpt
查看源码
12
uart_regs.pin
查看源码
13
prev_cmp_uart_regs.qmsg
查看源码
14
uart_regs.map.smsg
查看源码
15
uart_regs.fit.eqn
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