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VHDL/FPGA/Verilog
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用Verilog语言实现信号发生器
用Verilog语言实现信号发生器
VHDL/FPGA/Verilog
6 K
196 次下载
2013-12-09
资源详细信息
文件格式
RAR
文件大小
6 K
资源分类
VHDL/FPGA/Verilog
上传者
wait2010
发布时间
2013-12-09 18:50
下载统计
196
次
所需积分
2 积分
用Verilog语言实现信号发生器 - 资源详细说明
用Verilog语言实现信号发生器,包括AM,FM,PM,ASK,PSK,FSK调制。
用Verilog语言实现信号发生器 - 源码文件列表
本资源包含 1 个源码文件
支持在线预览,点击文件名即可查看
1
dds6.v
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