💻 这是一个用MAX+PLUSII开发FPGA（1K30器件）开发的李沙育图形发生器（硬件描述语言部分） - 源码文件列表

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源码文件总数： 50 个
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序号
文件名
文件大小
操作
251
📄 test.hif
6.43 KB
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252
📄 phader.cnf
0 B
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253
📄 test2.gdf
0 B
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254
📄 bchanle.hif
3.53 KB
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255
📄 hz100(3).cnf
0 B
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256
📄 u3610978.dls
0 B
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257
📄 test.pin
7.38 KB
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258
📄 sysclk(2).cnf
0 B
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259
📄 u5458936.dls
0 B
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260
📄 achanle.ndb
0 B
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261
📄 test2(20).cnf
0 B
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262
📄 phader.ttf
64 KB
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263
📄 test2(6).cnf
0 B
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264
📄 sysclk.vhd
458 B
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265
📄 top(45).cnf
0 B
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266
📄 test2(5).cnf
0 B
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267
📄 bfenpin(5).cnf
0 B
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268
📄 key.hif
1.51 KB
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269
📄 hz100.ttf
64 KB
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270
📄 test2(2).cnf
0 B
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271
📄 test2.snf
0 B
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272
📄 phyuz.ndb
0 B
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273
📄 mcu.scf
0 B
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274
📄 test2.hif
10.16 KB
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275
📄 bchanle.pin
7.38 KB
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276
📄 top.hex
64 KB
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277
📄 u8843451.dls
0 B
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278
📄 u3377262.dls
0 B
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279
📄 test2(17).cnf
0 B
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280
📄 achanle(3).cnf
0 B
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281
📄 hz100.sym
0 B
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282
📄 lisha.acf
14.47 KB
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283
📄 u9388405.dls
0 B
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284
📄 u2716340.dls
0 B
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285
📄 tryadder.cnx
1.69 KB
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286
📄 hz100.hif
4.59 KB
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287
📄 top(1).cnf
0 B
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288
📄 phader(7).cnf
0 B
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289
📄 top(8).cnf
0 B
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290
📄 top.acf
16.36 KB
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291
📄 sysclock.hif
3.19 KB
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292
📄 phader.pof
0 B
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293
📄 bfreyuz.sym
0 B
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294
📄 key.gdf
0 B
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295
📄 sysclock.sym
0 B
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296
📄 top(31).cnf
0 B
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297
📄 hz100.ndb
0 B
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298
📄 phader(3).cnf
0 B
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299
📄 achanle.cnf
0 B
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300
📄 u9094707.dls
0 B
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