💻 基于地址总线接口的四倍频编码器信号接口的 FPGA实现 Verilog HDL的 - 源码文件列表

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源码文件总数： 44 个
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序号
文件名
文件大小
操作
101
📄 qep_data_bus.(7).cnf.hdb
0 B
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102
📄 qep_data_bus.(28).cnf.cdb
0 B
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103
📄 qep_data_bus.(22).cnf.hdb
0 B
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104
📄 qep_data_bus.cmp.hdb
0 B
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105
📄 qep_data_bus.(2).cnf.hdb
0 B
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106
📄 qep_data_bus.tan.qmsg
64 KB
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107
📄 qep_data_bus.sim.qmsg
2.92 KB
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108
📄 qep_data_bus.sgdiff.cdb
0 B
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109
📄 qep_data_bus.rtlv.hdb
0 B
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110
📄 qep_data_bus.(25).cnf.cdb
0 B
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111
📄 qep_data_bus.syn_hier_info
0 B
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112
📄 qep_data_bus.(24).cnf.cdb
0 B
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113
📄 qep_data_bus.hif
32.11 KB
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114
📄 qep_data_bus.map.qmsg
21.41 KB
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115
📄 qep_data_bus.(8).cnf.hdb
0 B
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116
📄 qep_data_bus.(18).cnf.hdb
0 B
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117
📄 qep_data_bus.(12).cnf.hdb
0 B
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118
📄 add_sub_6sh.tdf
5.04 KB
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119
📄 qep_data_bus.(1).cnf.cdb
0 B
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120
📄 qep_data_bus.(0).cnf.hdb
0 B
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121
📄 qep_data_bus.(21).cnf.hdb
0 B
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122
📄 qep_data_bus.(4).cnf.cdb
0 B
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123
📄 qep_data_bus.eds_overflow
4 B
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124
📄 qep_data_bus.(16).cnf.cdb
0 B
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125
📄 qep_data_bus.(11).cnf.hdb
0 B
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126
📄 qep_data_bus.atom.rvd
0 B
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127
📄 qep_data_bus.eco.cdb
0 B
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128
📄 qep_data_bus.rtlv_sg_swap.cdb
0 B
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129
📄 qep_data_bus.(22).cnf.cdb
0 B
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130
📄 qep_data_bus.sim.vwf
64 KB
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131
📄 qep_data_bus.(6).cnf.cdb
0 B
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132
📄 qep_data_bus.(24).cnf.hdb
0 B
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133
📄 qep_data_bus.(9).cnf.hdb
0 B
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134
📄 qep_data_bus.(13).cnf.hdb
0 B
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135
📄 qep_data_bus.(5).cnf.cdb
0 B
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136
📄 qep_data_bus.asm.qmsg
1.14 KB
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137
📄 qep_data_bus.(0).cnf.cdb
0 B
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138
📄 qep_data_bus.(20).cnf.cdb
0 B
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139
📄 qep_data_bus.fit.rpt
64 KB
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140
📃 sopc_builder_debug_log.txt
0 B
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141
📄 leospec.log
20.79 KB
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142
📄 qep_data_bus.v
3.33 KB
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143
📄 cmp_state.ini
2 B
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144
📄 test.ptf
670 B
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