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乘法器是硬件设计中的很常见也很重要的一个模块
乘法器是硬件设计中的很常见也很重要的一个模块
VHDL/FPGA/Verilog
303 K
181 次下载
2015-03-18
资源详细信息
文件格式
RAR
文件大小
303 K
资源分类
VHDL/FPGA/Verilog
上传者
IsabellaJ
发布时间
2015-03-18 10:12
下载统计
181
次
所需积分
2 积分
乘法器是硬件设计中的很常见也很重要的一个模块 - 资源详细说明
乘法器是硬件设计中的很常见也很重要的一个模块,它的VHDL硬件实现很好的解决了软件编程中做乘法速度慢的问题,在实时高速系统应用中或DSP软核或数字信号处理硬件实现算法中,经常能使用到乘法器,所以经典的高速乘法器IP 很有参考价值
乘法器是硬件设计中的很常见也很重要的一个模块 - 源码文件列表
本资源包含 1 个源码文件
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1
基于可编程逻辑器件的高速乘法器ip设计.caj
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