💻 这是我自己写的一个小小的VERILOG程序 - 源码文件列表

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源码文件总数： 50 个
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序号
文件名
文件大小
操作
1
📄 ram_256.sof
0 B
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2
📄 ram_256.tan.rpt
4.19 KB
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3
📄 ram_256.v
361 B
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4
📄 ram_256.flow.rpt
4.25 KB
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5
📄 ram_256.pof
0 B
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6
📄 ram_256.qpf
903 B
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7
📄 ram_256.done
26 B
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8
📄 ram_256.asm.rpt
6.87 KB
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9
📄 ram_256.map.rpt
14.47 KB
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10
📄 ram_256.qsf
1.7 KB
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11
📄 ram_256.(0).cnf.cdb
0 B
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12
📄 ram_256.cmp.tdb
0 B
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13
📄 ram_256.syn_hier_info
0 B
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14
📄 ram_256.fit.qmsg
10.73 KB
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15
📄 ram_256.sgdiff.hdb
0 B
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16
📄 ram_256.tan.qmsg
1.61 KB
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17
📄 ram_256.rtlv_sg.cdb
0 B
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18
📄 ram_256.cmp.cdb
0 B
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19
📄 ram_256.signalprobe.cdb
0 B
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20
📄 ram_256.hif
570 B
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21
📝 ram_256.cbx.xml
89 B
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22
📄 ram_256.map.hdb
0 B
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23
📄 ram_256.rtlv.hdb
0 B
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24
📄 ram_256.sld_design_entry.sci
0 B
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25
📄 ram_256.db_info
136 B
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26
📄 ram_256.cmp.kpt
207 B
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27
📄 ram_256.asm_labs.ddb
0 B
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28
📄 ram_256.map.cdb
0 B
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29
📄 ram_256.dbp
0 B
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30
📄 ram_256.cmp.hdb
0 B
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31
📄 ram_256.sgdiff.cdb
0 B
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32
📄 ram_256.cmp2.ddb
0 B
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33
📄 ram_256.pre_map.hdb
0 B
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34
📄 ram_256.eco.cdb
0 B
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35
📄 ram_256.sld_design_entry_dsc.sci
0 B
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36
📄 ram_256.(0).cnf.hdb
0 B
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37
📄 ram_256.map.qmsg
4.06 KB
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38
📄 ram_256.asm.qmsg
1.75 KB
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39
📄 ram_256.psp
0 B
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40
📄 ram_256.hier_info
34 B
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41
📄 ram_256.map.logdb
4 B
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42
📄 ram_256.cmp.rdb
0 B
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43
📄 ram_256.cmp0.ddb
0 B
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44
📄 ram_256.cmp.logdb
4 B
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45
📄 ram_256.pre_map.cdb
0 B
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46
📄 ram_256.rtlv_sg_swap.cdb
0 B
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47
📄 ram_256.pin
26.15 KB
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48
📄 ram_256.fit.summary
483 B
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49
📄 ram_256.qws
609 B
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50
📄 ram_256.map.summary
377 B
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