💻 H.264标准解码器全部verilog源码 - 源码文件列表

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源码文件总数： 50 个
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序号
文件名
文件大小
操作
1
📄 ram_async_1r_sync_1w.v
2.71 KB
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2
📄 ext_frame_ram0_wrapper.v
5.09 KB
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3
📄 beha_bitstream_ram.v
1.16 KB
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4
📄 bitstream_parser_fsm_gating.v
27.58 KB
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5
⚙️ verilog.asm
0 B
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6
📄 _primary.dat
0 B
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7
📄 _primary.vhd
3.04 KB
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8
📄 _primary.dat
0 B
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9
📄 _primary.vhd
4.65 KB
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10
📄 _primary.dat
0 B
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11
📄 _primary.vhd
749 B
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12
📄 _primary.dat
0 B
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13
📄 _primary.vhd
419 B
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14
📄 _info
2.66 KB
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15
⚙️ verilog.asm
0 B
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16
📄 _primary.dat
0 B
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17
📄 _primary.vhd
902 B
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18
📄 _primary.dat
0 B
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19
📄 _primary.vhd
585 B
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20
📄 _primary.dat
0 B
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21
📄 _primary.vhd
307 B
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22
📄 _primary.dat
0 B
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23
📄 _primary.vhd
3.73 KB
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24
📄 _primary.dat
0 B
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25
📄 _primary.vhd
11 KB
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26
📄 _primary.dat
0 B
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27
📄 _primary.vhd
291 B
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28
⚙️ verilog.asm
0 B
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29
📄 _primary.dat
0 B
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30
📄 _primary.vhd
1.23 KB
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31
⚙️ verilog.asm
0 B
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32
📄 _primary.dat
0 B
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33
📄 _primary.vhd
4.99 KB
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34
📄 rec_df_ram1_wrapper.v
1.73 KB
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35
📄 reconstruction.v
22.49 KB
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36
📄 total_zeros_decoding.v
14.96 KB
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37
📄 timescale.v
546 B
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38
📄 inter_mv_decoding.v
64 KB
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39
📄 df_mem_ctrl.v
29.69 KB
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40
📄 ram_sync_1r_sync_1w.v
3.01 KB
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41
📄 cavlc_decoder.v
10.33 KB
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42
📄 dependent_variable_decoding.v
2.42 KB
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43
📄 df_reg_ctrl.v
15.94 KB
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44
📄 df_pipeline.v
33.65 KB
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45
📄 numcoefftrailingones_decoding.v
25.79 KB
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46
📄 rec_df_ram_ctrl.v
6.42 KB
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47
📄 rec_df_ram0_wrapper.v
1.73 KB
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48
📄 bitstream_controller.v
25.6 KB
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49
📄 syntax_decoding.v
24.94 KB
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50
📄 sum.v
23.78 KB
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