💻 运行在FPGA上的Verilog程序(实现对ADC的控制)... - 源码文件列表

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1
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1.03 KB
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2
📄 sample.fit.eqn
6.35 KB
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3
📄 adcint.vhd
2.28 KB
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4
📄 sample.qsf
2.94 KB
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5
📄 sample.map.summary
313 B
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6
📄 sample.bsf
3.47 KB
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7
📄 sample.map.eqn
5.48 KB
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8
📄 sample.fit.summary
406 B
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9
📄 sample.pof
0 B
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10
📄 sample.sim.rpt
10.27 KB
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11
📄 sample.v
2.13 KB
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12
📄 stp1.stp
8.52 KB
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13
📄 sample.qpf
905 B
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14
📄 sample.pin
19.12 KB
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15
📄 sample.tan.summary
1.45 KB
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16
📄 sample.signalprobe.cdb
0 B
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17
📄 sample.(14).cnf.hdb
0 B
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18
📄 sample.(20).cnf.cdb
0 B
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19
📄 sample.sgdiff.hdb
0 B
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20
📄 sample.rtlv_sg.cdb
0 B
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21
📄 sample.(28).cnf.hdb
0 B
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22
📄 sample.(10).cnf.hdb
0 B
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23
📄 sample.(14).cnf.cdb
0 B
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24
📄 cntr_kkb.tdf
3.92 KB
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25
📄 sample.(23).cnf.cdb
0 B
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26
📄 sample.(38).cnf.hdb
0 B
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27
📄 sample.(41).cnf.hdb
0 B
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28
📄 sample.(30).cnf.cdb
0 B
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29
📄 sample.(17).cnf.cdb
0 B
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30
📄 sample.(11).cnf.hdb
0 B
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31
📄 sample.(5).cnf.cdb
0 B
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32
📄 sample.(2).cnf.cdb
0 B
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33
📄 sample.(34).cnf.cdb
0 B
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📄 sample.hier_info
1.27 KB
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35
📄 cntr_lbc.tdf
3.89 KB
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36
📄 sample.cmp.hdb
0 B
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37
📄 sample.db_info
136 B
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38
📄 decode_9ie.tdf
3.34 KB
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39
📄 sample.(0).cnf.cdb
0 B
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40
📄 sample.(29).cnf.hdb
0 B
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41
📝 sample.cbx.xml
88 B
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42
📄 sample.(39).cnf.hdb
0 B
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43
📄 sample.(2).cnf.hdb
0 B
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44
📄 sample.(32).cnf.cdb
0 B
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45
📄 sample.(27).cnf.cdb
0 B
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46
📄 sample.dbp
0 B
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47
📄 sample.(24).cnf.cdb
0 B
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48
📄 sample.hif
45.28 KB
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49
📄 sample.rtlv_sg_swap.cdb
0 B
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50
📄 sample.sgate_sm.rvd
0 B
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