💻 Altera 官方提供的SDRAM控制器,verilog的 - 源码文件列表

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源码文件总数： 44 个
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序号
文件名
文件大小
操作
1
📄 mt48lc8m16a2.v
1.02 KB
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2
📄 sdr_sdram.esf
471 B
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3
📄 sdr_sdram.csf
3.44 KB
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4
📄 sdr_sdram.vqm
64 KB
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5
📄 pll1.v
4.54 KB
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6
📄 _primary.dat
0 B
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7
📄 _primary.vhd
607 B
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8
📄 verilog.psm
0 B
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9
📄 _info
1.22 KB
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10
📄 _primary.dat
0 B
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11
📄 _primary.vhd
1020 B
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12
📄 verilog.psm
0 B
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13
📄 _primary.dat
0 B
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14
📄 _primary.vhd
1.26 KB
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15
📄 verilog.psm
0 B
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16
📄 _primary.dat
0 B
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17
📄 _primary.vhd
102 B
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18
📄 verilog.psm
0 B
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19
📄 _primary.dat
0 B
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20
📄 _primary.vhd
1.08 KB
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21
📄 verilog.psm
0 B
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22
📄 _primary.dat
0 B
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23
📄 _primary.vhd
256 B
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24
📄 verilog.psm
0 B
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25
📄 _primary.dat
0 B
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26
📄 _primary.vhd
898 B
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27
📄 verilog.psm
0 B
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28
📄 _primary.dat
0 B
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29
📄 _primary.vhd
1.29 KB
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30
📄 verilog.psm
0 B
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31
📃 readme.txt
673 B
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32
📄 modelsim.ini
7.55 KB
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33
📄 sdr_sdram_tb.v
21.92 KB
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34
📃 readme.txt
1.43 KB
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35
📄 sdr_sdram.pdf
0 B
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36
📄 control_interface.v
8.26 KB
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37
📄 sdr_sdram.v
6.78 KB
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38
📄 params.v
935 B
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39
📄 sdr_data_path.v
2.68 KB
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40
📄 compile_all.v
206 B
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41
📄 command.v
16.92 KB
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42
📄 altclklock.v
8.34 KB
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43
📄 pll1.v
4.64 KB
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44
📄 sdr_sdram.prj
1.3 KB
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