💻 精通verilog_hdl语言编程实例程序代码 - 源码文件列表

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源码文件总数： 34 个
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序号
文件名
文件大小
操作
1
📄 dvb-c信道编、解码器.sch
0 B
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2
📄 transcript
0 B
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3
📄 cic3_decimator.v
1.65 KB
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4
📄 cordic.v
2.81 KB
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5
📄 randomization.v
1.98 KB
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6
📄 rom_inv.mif
3.37 KB
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7
📄 cheinsearch.v
2.94 KB
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8
📄 ff_mul.v
4.88 KB
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9
📄 rom_power.v
5.71 KB
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10
📄 rom_inv.v
5.69 KB
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11
📄 rom_power.mif
0 B
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12
📃 rs(204,188)译码器说明.txt
553 B
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13
📄 rs_decoder.v
1.89 KB
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14
📄 syndromecalc.v
2.63 KB
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15
📄 forney.v
9.17 KB
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16
📄 bm_kes.v
4.98 KB
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17
📄 rest_div_int.v
919 B
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18
📄 seq_div.v
3.06 KB
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19
📄 ff_const_mul.v
1.04 KB
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20
📄 ff_mul.v
1.64 KB
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21
📄 transcript
0 B
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22
📄 carry_skip_adder.v
1.44 KB
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23
📄 carry_chain_adder.v
472 B
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24
📄 ripple_carry_adder.v
455 B
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25
📄 fir_gen.v
1.8 KB
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26
📄 carry_save_mult.v
1002 B
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27
📄 ripple_carry_mult.v
1.03 KB
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28
📄 basic_base2_mul_seq.v
863 B
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29
📄 basic_base2_mul.v
644 B
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30
📄 wptr_full.v
855 B
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31
📄 rptr_empty.v
829 B
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32
📄 dp_ram.v
532 B
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33
📄 async_fifo.v
1.44 KB
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34
📄 async_cmp.v
718 B
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