💻 设计与验证Verilog_实例 - 源码文件列表

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源码文件总数： 50 个
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序号
文件名
文件大小
操作
1
📄 state2_cons_ui.tcl
199 B
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2
📄 state2.plg
487 B
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3
📄 state2.msg
437 B
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4
📄 fsm_tmp_cons_ui.tcl
199 B
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5
📄 state2.vif
1.45 KB
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6
📄 state1.msg
749 B
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7
📄 state1.plg
251 B
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8
📄 state1.vif
1.53 KB
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9
📄 state3.plg
251 B
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10
📄 state2_default.plg
291 B
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11
📄 _primary.vhd
317 B
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12
📄 _primary.vhd
151 B
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13
📄 _primary.vhd
221 B
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14
📄 _primary.vhd
82 B
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15
📄 single_if.plg
23 B
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16
📄 rtlc_version_info
49 B
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17
📄 rtlc_args1.file
4.01 KB
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18
📄 .top
28 B
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19
📄 legalmodmap.db
46 B
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20
📄 rtlc.args
1.83 KB
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21
📄 topmodule.list
11 B
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22
📄 autotop.conf
78 B
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23
📄 if_single_decode.plg
23 B
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24
📄 rtlc_version_info
49 B
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25
📄 rtlc_args1.file
4.02 KB
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26
📄 .top
35 B
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27
📄 legalmodmap.db
60 B
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28
📄 rtlc.args
1.83 KB
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29
📄 topmodule.list
18 B
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30
📄 autotop.conf
83 B
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31
📄 if_mult_decode.plg
23 B
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32
📄 rtlc_version_info
49 B
查看源码
33
📄 rtlc_args1.file
4.02 KB
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34
📄 .top
33 B
查看源码
35
📄 legalmodmap.db
56 B
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36
📄 rtlc.args
1.83 KB
查看源码
37
📄 topmodule.list
16 B
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38
📄 autotop.conf
77 B
查看源码
39
📄 rtlc_version_info
49 B
查看源码
40
📄 rtlc_args1.file
4.01 KB
查看源码
41
📄 .top
30 B
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42
📄 legalmodmap.db
50 B
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43
📄 rtlc.args
1.83 KB
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44
📄 topmodule.list
13 B
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45
📄 autotop.conf
68 B
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46
📄 case_decode.plg
23 B
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47
📄 mult_if.plg
23 B
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48
📄 mult_if.msg
465 B
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49
📄 rtlc_version_info
49 B
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50
📄 rtlc_args1.file
4 KB
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