💻 用verilogHDL写的一个risc处理器 - 源码文件列表

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源码文件总数： 19 个
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序号
文件名
文件大小
操作
1
📋 _multiplexer__5ch.h
989 B
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2
📋 glbl.h
946 B
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3
📋 _address___register.h
1 KB
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4
📋 _alu___r_i_s_c.h
1002 B
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5
📋 _processing___unit.h
995 B
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6
📋 _multiplexer__3ch.h
989 B
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7
📄 xsimtestbench.cpp
5.2 KB
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8
📋 testbench.h
971 B
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9
📋 _memory___unit.h
995 B
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10
📄 xsim_memory___unit.cpp
1.75 KB
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11
📋 _register___unit.h
1011 B
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12
📋 _instruction___register.h
1.02 KB
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13
📋 _control___unit.h
1.27 KB
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14
📄 xsimtestbench__v.cpp
5.22 KB
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15
📋 testbench__v.h
1.23 KB
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16
📋 _d__flop.h
945 B
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17
📋 _r_i_s_c___s_p_m.h
985 B
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18
📋 _program___counter.h
1021 B
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19
📄 ntrc.scr
1.06 KB
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