💻 FPGA-CPLD_DesignTool(8-9-10)源代码请需要的朋友下载 - 源码文件列表

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源码文件总数： 50 个
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序号
文件名
文件大小
操作
1
📄 mfea_tcl.rsp
12 B
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2
📄 incremental_demo.gfl
2.59 KB
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3
📄 mapfloorplanner.rsp
18 B
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4
📄 nc1toncd_tcl.rsp
12 B
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5
📄 edntongd_tcl.rsp
54 B
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6
📄 bitgen.rsp
579 B
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7
📄 top_ncdtout_tcl.rsp
18 B
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8
📄 parentcreateareaconstraintsapp_tcl.rsp
18 B
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9
📄 coregen.rsp
109 B
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10
📄 netlist.lst
78 B
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11
📄 rtl.srd
2.14 KB
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12
📄 model.srd
3.28 KB
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13
📄 mapped.srd
3.28 KB
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14
📄 top.plg
1.25 KB
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15
📄 rtl.srd
12.45 KB
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16
📄 model.srd
7.34 KB
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17
📄 mapped.srd
7.34 KB
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18
📄 rtl.srd
2.14 KB
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19
📄 model.srd
3.28 KB
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20
📄 mapped.srd
3.28 KB
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21
📄 rtl.srd
2.26 KB
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22
📄 model.srd
3.3 KB
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23
📄 mapped.srd
3.29 KB
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24
📄 stopwatch.edf
64 KB
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25
📄 stopwatch.srm
45.65 KB
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26
📄 stopwatch.srd
31.4 KB
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27
📄 stopwatch.ncf
1.08 KB
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28
📄 stopwatch.srs
21.1 KB
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29
📄 stopwatch.srr
64 KB
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30
📄 stopwatch.tlg
1.54 KB
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31
📄 stopwatch.edf
64 KB
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32
📄 stopwatch.srm
45.3 KB
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33
📄 stopwatch.plg
1.29 KB
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34
📄 stopwatch.srd
31.05 KB
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35
📄 stopwatch.ncf
1.08 KB
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36
📄 stopwatch.srs
21.08 KB
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37
📄 stopwatch.srr
35.5 KB
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38
📄 stmach_v.plg
449 B
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39
📄 stopwatch.tlg
1.54 KB
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40
📄 stmach_v.srd
3.87 KB
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41
📄 hdllib.ref
1.08 KB
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42
📄 hdpdeps.ref
1.4 KB
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43
📄 vhdllib.ref
1.57 KB
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44
📄 hdpdeps.ref
3.45 KB
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45
📄 top_routed.twr
2.97 KB
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46
📄 module_c.edf
6.29 KB
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47
📄 top_routed.par
13.15 KB
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48
📄 top_routed.xpi
46 B
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49
📄 top.mrp
7.18 KB
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50
📄 top.bld
2.19 KB
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