💻 arm9_fpga2_verilog是一个可以综合的用verilog写的arm9的ip软核 - 源码文件列表

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源码文件总数： 50 个
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序号
文件名
文件大小
操作
1
📄 pex_synth.vhd
39.08 KB
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2
📄 regfile.v
13.98 KB
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3
📄 pex_mezz_mem_if_entarch.vhd
16.99 KB
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4
📄 pe_arm2mem_if_entarch.vhd
14.14 KB
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5
📄 mmu_new.v
34.19 KB
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6
📄 shifter.v
8.97 KB
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7
📄 ram1p.v
3.08 KB
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8
📄 systolic_io_entarch.vhd
4 KB
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9
📄 pe_pkg.vhd
54.4 KB
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10
📄 xilinx_pkg.vhd
34.42 KB
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11
📄 wave.do
4.56 KB
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12
📄 clock_io_entarch.vhd
2.94 KB
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13
📄 systolic_if_entarch.vhd
4.44 KB
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14
📄 miniram.v
2.63 KB
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15
📄 readme
4.94 KB
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16
📄 project_vcom.do
4.4 KB
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17
📄 pex_ent.vhd
3.54 KB
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18
📄 comp42_2.v
3.19 KB
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19
📄 modelsim.ini
6.79 KB
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20
📄 ex.v
36.32 KB
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21
📄 ifetch.v
24.64 KB
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22
📄 arm9.v
9.95 KB
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23
📄 host.vhd
31.63 KB
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24
📄 ram2p.v
4.89 KB
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25
📄 pipe.v
7.82 KB
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26
📄 tag.v
1.6 KB
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27
📄 itag_synth.v
1.53 KB
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28
📄 dtag.v
2.62 KB
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29
📄 lad_bus_io_entarch.vhd
17.84 KB
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30
📄 mem_init.dat
114 B
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31
📄 pe_mezz_mem_pkg.vhd
12.69 KB
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32
📄 mult.v
10.44 KB
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33
📄 mem_io_entarch.vhd
7.06 KB
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34
📄 led_io_entarch.vhd
2.46 KB
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35
📄 clock_if_entarch.vhd
15.92 KB
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36
📄 lad_bus_if_entarch.vhd
10.75 KB
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37
📄 mezz_mem_card_cfg.vhd
5.15 KB
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38
📄 icache.v
9.67 KB
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39
📄 testarm.vhx
1.75 KB
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40
📄 mapreg.v
2.25 KB
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41
📄 mainmem.v
1.89 KB
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42
📄 mapspsr.v
1.55 KB
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43
📄 itag.v
2.15 KB
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44
📄 host_icomp.vhd
39.19 KB
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45
📄 project_vsim.do
1.39 KB
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46
📄 ppselect.v
2.2 KB
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47
📄 pardef
5.2 KB
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48
📄 mem_copy.c
40.26 KB
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49
📄 pex.fes
5.81 KB
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50
📄 pex.ucf
14.63 KB
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