辛辛苦苦的作品应用于DE2 的 开发。。希望对大家有用。 - 源码列表
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源码文件 83
下载 83
源码文件列表
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文件名
大小
操作
1
pdf de2_outline.pdf 二进制
-
不可预览
2
pdf de2_schematics.pdf 二进制
-
不可预览
4
pdf lab5_vhdl.pdf 二进制
-
不可预览
5
pdf lab10_vhdl.pdf 二进制
-
不可预览
6
pdf lab3_vhdl.pdf 二进制
-
不可预览
7
pdf lab6_vhdl.pdf 二进制
-
不可预览
8
pdf lab4_vhdl.pdf 二进制
-
不可预览
9
pdf lab2_vhdl.pdf 二进制
-
不可预览
10
pdf lab9_vhdl.pdf 二进制
-
不可预览
11
pdf lab8_vhdl.pdf 二进制
-
不可预览
12
pdf lab1_vhdl.pdf 二进制
-
不可预览
13
pdf lab7_vhdl.pdf 二进制
-
不可预览
14
pdf lab4_verilog.pdf 二进制
-
不可预览
15
pdf lab7_verilog.pdf 二进制
-
不可预览
16
pdf lab1_verilog.pdf 二进制
-
不可预览
17
pdf lab9_verilog.pdf 二进制
-
不可预览
18
pdf lab3_verilog.pdf 二进制
-
不可预览
19
pdf lab2_verilog.pdf 二进制
-
不可预览
20
pdf lab10_verilog.pdf 二进制
-
不可预览
21
pdf lab6_verilog.pdf 二进制
-
不可预览
22
pdf lab5_verilog.pdf 二进制
-
不可预览
23
pdf lab8_verilog.pdf 二进制
-
不可预览
24
pdf tut_timing_verilog.pdf 二进制
-
不可预览
25
pdf tut_simulation_verilog.pdf 二进制
-
不可预览
26
pdf tut_quartus_intro_vhdl.pdf 二进制
-
不可预览
27
pdf tut_lpms_vhdl.pdf 二进制
-
不可预览
28
pdf tut_quartus_intro_verilog.pdf 二进制
-
不可预览
34
pdf tut_initialde2.pdf 二进制
-
不可预览
35
pdf tut_simulation_vhdl.pdf 二进制
-
不可预览
36
pdf tut_quartus_intro_schem.pdf 二进制
-
不可预览
37
pdf tut_lpms_verilog.pdf 二进制
-
不可预览
38
pdf tut_timing_vhdl.pdf 二进制
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不可预览
44
pdf image_convert_english.pdf 二进制
-
不可预览
45
exe imgconv.exe 二进制
-
不可预览
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