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经典的verilog语言学习课件,介绍了语言的基础知识,和实际中该语言的应用包括DSP 设计中的各个方面. - 源码文件列表
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源码文件总数:
16
个
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1
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组合逻辑电路描述.ppt
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2
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fsm设计描述.ppt
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3
📄
how to design a hdl module?.ppt
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4
📄
testbench.ppt
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5
📄
连续输入数据处理.ppt
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6
📄
fifo设计.ppt
0 B
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7
📄
switch_level.ppt
0 B
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8
📄
verilog_coding_style_0902.ppt
0 B
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9
📄
testbenches.ppt
0 B
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10
📄
vslides.ppt
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11
📄
combined add and subtractor.ppt
0 B
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12
📄
模拟及数模混合集成电路设计分析.doc
0 B
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13
📄
组合电路设计描述的优化问题.ppt
0 B
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14
📄
第二个题目.ppt
0 B
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15
📄
时序电路设计描述.ppt
0 B
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16
📄
verilog_coding_style.ppt
0 B
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