💻 这是一个很好的Verilog 编写的8位RISC CPU源码（可做为MCU） - 源码文件列表

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源码文件总数： 26 个
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序号
文件名
文件大小
操作
1
📄 eth_receivecontrol.v
13.22 KB
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2
📄 timescale.v
2.93 KB
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3
📄 eth_crc.v
7.02 KB
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4
📄 eth_transmitcontrol.v
9.35 KB
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5
📄 eth_txstatem.v
9.58 KB
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6
📄 eth_macstatus.v
11.2 KB
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7
📄 eth_registers.v
26.59 KB
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8
📄 eth_random.v
5.59 KB
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9
📄 eth_maccontrol.v
10.5 KB
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10
📄 eth_shiftreg.v
6.47 KB
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11
📄 eth_register.v
4.43 KB
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12
📄 eth_rxethmac.v
12.14 KB
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13
📄 eth_wishbone.v
62.07 KB
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14
📄 eth_fifo.v
5.48 KB
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15
📄 eth_miim.v
15.44 KB
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16
📄 eth_top.v
28.45 KB
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17
📄 eth_rxstatem.v
7.06 KB
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18
📄 eth_rxaddrcheck.v
6.14 KB
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19
📄 eth_defines.v
9.06 KB
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20
📄 eth_clockgen.v
5.26 KB
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21
📄 eth_txethmac.v
16.63 KB
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22
📄 eth_txcounters.v
8.52 KB
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23
📄 eth_outputcontrol.v
6.05 KB
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24
📄 eth_rxcounters.v
8.09 KB
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25
📄 eth_spram_256x32.v
4.84 KB
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26
📄 eth_cop.v
11.71 KB
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