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用VERILOG实现的秒表 用VERILOG实现的秒表
利用fpga实现秒表。秒表有开始停止,清零的功能
实现秒表的功能,从0到60的秒表计时,并具有可调功能,且在硬件上已实现成功。
TPC-H上秒表的实现
用VHDL实现秒表功能,使得用户能够更节省时间和资源
秒表计时器的verilog实现,是一个教授发表的学术论文。有点参考意义。
用vhdl实现秒表的功能,具有秒表功能,有分、秒显示,后期可以自己添加闹钟的模块。
用delphi实现的秒表功能, 测试通过
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