动态功耗调节介绍
在今天的数据采集系统(DAQ)中，需要不断突破性能极限。系统设计人员需要更高的速度、更低的噪声和更优的总谐波失真(THD)性能，所有这些都有可能实现，但却并非免费。实现这些性能改进通常需要更大的工作电流，而更大的工作电流则会产生更高的功耗。但是，在许多应用中，功耗敏感性也越来越受关注。原因有很多种。...
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查看全部10000个资源 »FPGA资源动态重构及低功耗研究.rar
DSP和FPGA相关方面的论文，对提高DSP相关方面的理论水平很有帮助...
FPGA资源动态重构及低功耗研究.rar
随着可编程逻辑门阵列(FPGA，Field Programmanle Gate Array)应用的不断普及，便携式设备和无线设备的涌现，过去对于FPGA主要关心的速度、单片容量、费用以及可靠性等，现在对于低功耗FPGA的需求，与速度、容量、费用等到了一样的高度，成为FPGA设计者和使用者主要关心的问...
WP370 -采用智能时钟门控技术降低动态开关功耗
赛灵思推出业界首款自动化精细粒度时钟门控解决方案，该解决方案可将 Virtex®-6 和 Spartan®-6 FPGA 设计方案的动态功耗降低高达 30%。赛灵思智能时钟门控优化可自动应用于整个设计，既无需在设计流程中添加更多新的工具或步骤，又不会改变现有...
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