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IEEE JSSC论文(1960~2005).part044.rar

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标签： IEEE 1960 2005 JSSC

上传时间： 2013-06-27

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IEEE JSSC论文(1960~2005).part017.rar

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上传时间： 2013-04-24

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IEEE JSSC论文(1960~2005).part023.rar

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上传时间： 2013-07-31

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全加器verilog程序

四位全加器verilog源码，简单实用！欢迎下载

标签： verilog 全加器程序

上传时间： 2013-05-16

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IEEE JSSC论文(1960~2005).part014.rar

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标签： IEEE 1960 2005 JSSC

上传时间： 2013-04-24

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AGC verilog实现

verilog实现一个AGC模块，信号输入位宽16位，通过统计64个输入完成其功率的统计，然后根据功率大小对信号进行缩放。

标签： verilog AGC

上传时间： 2013-06-09

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IEEE JSSC论文(1960~2005).part087.rar

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标签： IEEE 1960 2005 JSSC

上传时间： 2013-07-22

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IEEE JSSC论文(1960~2005).part043.rar

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上传时间： 2013-04-24

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上传时间： 2013-08-03

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IEEE JSSC论文(1960~2005).part052.rar

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上传时间： 2013-04-24

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