TLC2543是TI公司的12位串行模数转换器，使用开关电容逐次逼近技术完成A/D转换过程。由于是串行输入结构，能够节省51系列单片机I/O资源；且价格适中，分辨率较高，因此在仪器仪表中有较为广泛的应用。 TLC2543的特点 （1）12位分辩率A/D转换器； （2）在工作温度范围内10μs转换时间； （3）11个模拟输入通道； （4）3路内置自测试方式； （5）采样率为66kbps； （6）线性误差±1LSBmax； （7）有转换结束输出EOC； （8）具有单、双极性输出； （9）可编程的MSB或LSB前导； （10）可编程输出数据长度。 TLC2543的引脚排列及说明 TLC2543有两种封装形式：DB、DW或N封装以及FN封装，这两种封装的引脚排列如图1，引脚说明见表1 TLC2543电路图和程序欣赏 #include<reg52.h> #include<intrins.h> #define uchar unsigned char #define uint unsigned int sbit clock=P1^0; sbit d_in=P1^1; sbit d_out=P1^2; sbit _cs=P1^3; uchar a1,b1,c1,d1; float sum,sum1; double sum_final1; double sum_final; uchar duan[]={0x3f,0x06,0x5b,0x4f,0x66,0x6d,0x7d,0x07,0x7f,0x6f}; uchar wei[]={0xf7,0xfb,0xfd,0xfe}; void delay(unsigned char b) //50us { unsigned char a; for(;b>0;b--) for(a=22;a>0;a--); } void display(uchar a,uchar b,uchar c,uchar d) { P0=duan[a]|0x80; P2=wei[0]; delay(5); P2=0xff; P0=duan[b]; P2=wei[1]; delay(5); P2=0xff; P0=duan[c]; P2=wei[2]; delay(5); P2=0xff; P0=duan[d]; P2=wei[3]; delay(5); P2=0xff; } uint read(uchar port) { uchar i,al=0,ah=0; unsigned long ad; clock=0; _cs=0; port<<=4; for(i=0;i<4;i++) { d_in=port&0x80; clock=1; clock=0; port<<=1; } d_in=0; for(i=0;i<8;i++) { clock=1; clock=0; } _cs=1; delay(5); _cs=0; for(i=0;i<4;i++) { clock=1; ah<<=1; if(d_out)ah|=0x01; clock=0; } for(i=0;i<8;i++) { clock=1; al<<=1; if(d_out) al|=0x01; clock=0; } _cs=1; ad=(uint)ah; ad<<=8; ad|=al; return(ad); } void main() { uchar j; sum=0;sum1=0; sum_final=0; sum_final1=0; while(1) { for(j=0;j<128;j++) { sum1+=read(1); display(a1,b1,c1,d1); } sum=sum1/128; sum1=0; sum_final1=(sum/4095)*5; sum_final=sum_final1*1000; a1=(int)sum_final/1000; b1=(int)sum_final%1000/100; c1=(int)sum_final%1000%100/10; d1=(int)sum_final%10; display(a1,b1,c1,d1); } }
上传时间： 2013-11-19
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#include<iom16v.h> #include<macros.h> #define uint unsigned int #define uchar unsigned char uint a,b,c,d=0; void delay(c) { for for(a=0;a<c;a++) for(b=0;b<12;b++); }; uchar tab[]={ 0xc0,0xf9,0xa4,0xb0,0x99,0x92,0x82,0xf8,0x80,0x90,
上传时间： 2013-10-21
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阐述了一个由上位PC机和AT89C52下位单片机组成的主从分布式温度巡回检测系统。主从机采用RS-485 串行通讯标准进行通信，可在下位单片机实现基本的温度数据巡回检测基础上，由上位PC机实现综合处理功能或扩展为远程操作。整个系统具有巡检速度快，扩展性好的特点。 Abstract: In this paper,a top PC and AT89C52 under-bit microcontrollers from the main component of the tour distributed temperature detection system is presented. Master and slave can use RS-485 serial communication standards for communications.Based on next-bit machine for basic goods temperature detected data Tour, the top can achieve the integrated treatment of PC functions or for the expansion of long-distance operation. The entire inspection system is fast, expansion.
上传时间： 2013-10-13
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在现代化的工业现场，常用热电偶测试高温，测试结果送至主控机。由于热电偶的热电势与温度呈非线性关系，所以必须对热电偶进行线性化处理以保持测试精度。该系统通过高精度模/数转换器AD7705 对热电偶电动势进行采样、放大，并在单片机内采用一定算法实现对热电偶的线性化处理，再通过数/模转换器AD421 进行数/模转换产生4mA～20mA 电流，送主控中心。
上传时间： 2013-10-29
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S3C2440开发板使用手册:在阳初2440 开发板上，我们使用了mizi 公司开发的开放源代码启动程序vivi 来作为bootloader，在原有vivi的基础上，我们增加了VGA/TV芯片初始化等功能。vivi我们使用来下载Linux 的映象，将来会扩展到支持下载WindowsCE 的映象。经阳初改进后，vivi的基本功能－ 启动操作系统－ 通过xmodem协议下载映象文件－ 通过USB DEVICE 接口下载映象文件（开发中，暂不提供）－ 通过网络接口下载映象文件（开发中，暂不提供）－ 设置操作系统启动参数－ 初始化硬件
上传时间： 2013-12-20
上传用户：xiaohanhaowei
高性能可编程DMA控制接口82C37A-54.1 概述对象实体：直接存储器访问（DMA）控制接口芯片82C37A-5芯片的特点：1、管脚引线与NMOS 8237A-5兼容。2、允许/禁止单独DMA请求控制。3、频率从0~5MHz区间全静态设计。4、低电平操作。 5、4个各自独立的DMA通道并独立的进行初始化。6、存储器到存储器之间传送。7、存储器模块初始化处理。8、地址的增量和减量。9、传送速率可达1.6MB/s.10、可直接扩展成任意数量的通道。11 、终止传送的过程即输入结束。12、软件请求。13、独立信号DREQ和信号DACK的极性控制。4.2 82C37A-5的体系结构4.2.1 基本结构描述1. 82C37A-5内部配备了规模为344位的内部存储器，它是以寄存器的形式出现的。2. 配有3个基本的控制模块： （1）定时及控制模块； （2）优先级编码及循环优先级控制模块；（3）命令控制模块； 3. 12个不同类型的寄存器 。图 4-1 82C37A-5结构图EOP# A0~A3RESETCS#. IOW# DREQ0~DREQ3HLDAHRQ DB0~DB7DACK0~DACK3
上传时间： 2013-10-21
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DSP 芯片既具有高速数字信号处理功能,又具有实时性强、功耗低、集成度高等嵌入式微计算机的特点,所以随着科技的发展,DSP 技术在机电控制领域的应用愈加广泛。LED 可显示字符,且显示清晰美观、功耗低,在电子产品中也广泛应用。
上传时间： 2013-11-14
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从消费类电子到工业、电信基础架构设备，FPGA与连接外面世界的模拟及混合信号IC如影随形，当系统中需要多个关键元件实现数据采集和处理功能时，您可以考虑是否选择FPGA更实惠？如何确定哪些器件最适合您的应用，而且它们之间的协同工作能力更强呢？ Xilinx FPGA模拟方案产品指南将为您解答疑惑……
上传时间： 2013-11-04
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本文在分析了无线电频谱管理现状及频谱资源紧张的前提下，引出频谱管理中的认知无线电技术，同时提出了基于博弈论的电磁频谱管理的模型化方法，深入地分析了博弈论算法的收敛性及效用函数的选择，并且通过Matlab仿真以最小化系统间总干扰为目标描述了博弈论模型在电磁频谱动态管理中的应用。
上传时间： 2013-10-19
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设计了一种片上系统（SoC）复位电路。该电路能对外部输入信号进行同步化处理以抑制亚稳态，采用多级D触发器进行滤波提升抗干扰能力，并且控制产生系统所需的复位时序以满足软硬件协同设计需求。同时，完成了可测性设计（DFT）。基于Xilinx spartan-6 FPGA进行了验证。结果表明该电路可以抑制90 ?滋s以下的外部干扰信号，并能正确产生系统所需的复位信号。
上传时间： 2014-12-29
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