digital+PLL
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本文档主要是以Altera公司的Stratix II系列的FPGA器件为例，介绍了其内嵌的增强型可重配置PLL在不同的输入时钟频率之间的动态适应，其目的是通过提供PLL的重配置功能，使得不需要对FPGA进行重新编程就可以通过软件手段完成PL...
2013-11-02
27
Ph.D thesis from M.H.Perrott, about Fractional-N PLL design.
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2016-11-09
111
PhD.thesis about fractional PLL design from UC san-deago.
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2013-12-21
155
thesis related to vlsi area, pll and frequency synthesizer
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2017-08-18
158