分析了MATLAB/Simulink 中DSP Builder 模块库在FPGA 设计中优点
分析了MATLAB/Simulink 中DSP Builder 模块库在FPGA 设计中优点,\\r\\n然后结合FSK 信号的产生原理,给出了如何利用DSP Builder 模块库建立FSK 信号发生器模\\r\\n型,以及对FSK 信号发生器模型进行算法级仿真和生成VHDL 语言的方法,并在mo...
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基于FPGA的键盘扫描模块的设计实现,感兴趣的请下载...
SDRAM控制模块;图象采集系统说明性稳当;DSP图象采集系统。SDRAM作为存储器。...
自己设计的Smartcard功能模块,已经通过vcs仿真和FPGA验证,可以使用。...
Verilog实现的DDS正弦信号发生器和测频测相模块,DDS模块可产生两路频率和相位差均可预置调整的值正弦波,频率范围为20Hz-5MHz,相位范围为0°-359°,测量的数据通过引脚传输给单片机,单片机进行计算和显示。...