Xilinx+V5

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xilinx的时序约束实验，通过阅读本文档，你可以用全局时序约束来轻松提高已有的项目的系统时钟频率，同时你还可以用映射后静态时序报告以及布局布线后静态时序报告来分析你的设计性能

2015-12-31 160 Xilinx+V5

xilinx实现4位频率计，可测量从1HZ到9999HZ的频率信号，并将被测的信号频率输出显示到实验仪的数码管上。

2016-03-01 156 Xilinx+V5

本程序用xilinx EDK9.1运行，通过microblaze软核，实现在sparton——3e板卡上的按键及开关的控制，通过RS－232与超级终端进行通信。

2016-10-02 30 Xilinx+V5