Xilinx+IP核
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可配置CRC参考设计 xilinx的ip
可配置CRC参考设计 xilinx的ip,参考设计文档CRC_xapp562[1].pdf,VHDL语言编写的代码,包含仿真所需文件
2014-08-25
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基于Verilog 的TLC2543 ip核
基于Verilog实现的TLC2543 IP核,支持11通道ADC采集,12位精度,提供8位并行输出接口,适用于高速数据采集系统设计。
2026-03-07
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