Verilog+Code

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verilog浮点乘发器，特定数据结构，指数底为10

2013-12-20 123 Verilog+Code

verilog浮点乘发器，特定数据结构，指数底为10,利用pipeline

2013-12-24 185 Verilog+Code

verilog浮点乘发器，特定数据结构，指数底为10,利用pipeline

2013-12-27 187 Verilog+Code

verilog浮点乘发器，特定数据结构，指数底为10

2014-01-26 195 Verilog+Code

2015-02-12 45 Verilog+Code

verilog HDL 编写的PWM，是初学CPLD者入门Z资源，epm7128stc100-10

2015-09-05 82 Verilog+Code

2014-01-01 154 Verilog+Code

2015-10-17 166 Verilog+Code

2014-01-22 196 Verilog+Code

verilog hdl教程135例，例子很好，对新学的很有帮助

2015-09-30 110 Verilog+Code