With the Altera Nios II embedded processor, you as the system designercan accelerate time-critical software algorithms by adding custominstructions to the Nios II processor instruction set. Using custominstructions, you can reduce a complex sequence of standard instructionsto a single instruction implemented in hardware. You can use this featurefor a variety of applications, for example, to optimize software innerloops for digital signal processing (DSP), packet header processing, andcomputation-intensive applications. The Nios II configuration wizard,part of the Quartus® II software’s Sopc Builder, provides a graphicaluser interface (GUI) used to add up to 256 custom instructions to theNios II processor
上传时间： 2013-11-07
上传用户：swing
基于使用户刷卡消费的数据可进行采集存储的目的，采用了在FPGA平台上设计一种射频卡实时消费记录系统的方法。该系统采用了FATFS文件系统，可将用户数据及时保存到SD卡之中。通过对软硬件模块和上位机的设计，采用FPGA为开发平台，对用户刷卡消费的记录写入到SD卡中。利用SD卡的移动性，可方便地实现与计算机的数据交换，达到数据分析的目的。此法便于客户对消费记录的核对，具有实际商业价值。
上传时间： 2013-11-17
上传用户：CHENKAI
如何利用Sopc制作点阵显示
上传时间： 2015-01-01
上传用户：王小奇
本文是描述在Quartus II 新建一个Sopc系统的过程，希望对大家有用
标签： NIOS
上传时间： 2013-11-25
上传用户：源弋弋
本教程内容力求以详细的步骤和讲解让读者以最快的方式学会 MC8051 IP core 的应用以及相关设计软件的使用，并激起读者对 Sopc 技术的兴趣。本实验重点讲 8051Core 的应用，并通过一个简单 C51 程序对51Core 进行硬件测试。 本实验教程的内容编排如下： 第 1 章简单的描述了 MC8051 IP core的基本结构及一些应用说明。 第 2 章详细的介绍 8051Core 综合、编译应用。包括 Quartus II、Synplify Pro 软件的基本应用，ROM、RAM 模块的生成，8051Core 的封装及应用测试。 附录 A为 MC8051 IP Core 的指令集。 在阅读本教程的过程中，请读者注意以下几点： 本教程在写作过程中遵循“宁可啰唆一点，也不放过细节”的方针。在教程中的某些地方，有些读者可能觉得很“简单” ，甚至显得有些啰唆，但对大多数初学者可能并非如此。因为作者认为，足够简单甚至可以跳过的内容，对某些读者来说，未必能一下子就弄清楚，所以，本教程很 多地方将尽量阐述清楚，以节省读者理解的时间。但在后面的章节中，如果涉及的细节在前面章节中已经提及，这些内容就会省略。 最 后作者要强调的是，本教程旨在引路，不会带领读者掌握更深层次的开发，更高级的应用希望读者自己去挖掘。
上传时间： 2013-10-26
上传用户：归海惜雪
Nios II定制指令用户指南：With the Altera Nios II embedded processor, you as the system designer can accelerate time-critical software algorithms by adding custom instructions to the Nios II processor instruction set. Using custom instructions, you can reduce a complex sequence of standard instructions to a single instruction implemented in hardware. You can use this feature for a variety of applications, for example, to optimize software inner loops for digital signal processing (DSP), packet header processing, and computation-intensive applications. The Nios II configuration wizard,part of the Quartus® II software’s Sopc Builder, provides a graphical user interface (GUI) used to add up to 256 custom instructions to the Nios II processor. The custom instruction logic connects directly to the Nios II arithmetic logic unit (ALU) as shown in Figure 1–1.
上传时间： 2013-10-12
上传用户：kang1923
Nios II 系列处理器配置选项:This chapter describes the Nios® II Processor parameter editor in Qsys and Sopc Builder. The Nios II Processor parameter editor allows you to specify the processor features for a particular Nios II hardware system. This chapter covers the features of the Nios II processor that you can configure with the Nios II Processor parameter editor; it is not a user guide for creating complete Nios II processor systems.
上传时间： 2015-01-01
上传用户：mahone
《Altera FPGA工程师成长手册》以altera公司的fpga为例，由浅入深，全面、系统地详细讲述了基于可编程逻辑技术的设计方法。《Altera FPGA工程师成长手册》讲解时穿插了大量典型实例，便于读者理解和演练。另外，为了帮助读者更好地学习，《Altera FPGA工程师成长手册》提供了配套语音教学视频，这些视频和《Altera FPGA工程师成长手册》源代码一起收录于《Altera FPGA工程师成长手册》配书光盘中。 《Altera FPGA工程师成长手册》涉及面广，从基本的软件使用到一般电路设计，再到nios ⅱ软核处理器的设计，几乎涉及fpga开发设计的所有知识。具体内容包括：eda开发概述、altera quartus ii开发流程、altera quartus ii开发向导、vhdl语言、基本逻辑电路设计、宏模块、lpm函数应用、基于fpga的dsp开发设计、Sopc系统构架、soc系统硬件开发、Sopc系统软件开发、nios ii常用外设、logiclock优化技术等。
上传时间： 2015-01-01
上传用户：123啊
为实现某专用接口装置的接口功能检测，文中详细地介绍了一种34位串行码的编码方式，并基于FPGA芯片设计了该类型编码的接收、发送电路。重点分析了电路各模块的设计思路。电路采用Sopc模块作为中心控制器，设计简洁、可靠。试验表明：该设计系统运行正常、稳定。
上传时间： 2013-10-09
上传用户：小宝爱考拉
以Altera公司的Quartus Ⅱ 7.2作为开发工具，研究了基于FPGA的DDS IP核设计，并给出基于Signal Tap II嵌入式逻辑分析仪的仿真测试结果。将设计的DDS IP核封装成为Sopc Builder自定义的组件，结合32位嵌入式CPU软核Nios II，构成可编程片上系统（Sopc），利用极少的硬件资源实现了可重构信号源。该系统基本功能都在FPGA芯片内完成，利用 Sopc技术，在一片 FPGA 芯片上实现了整个信号源的硬件开发平台，达到既简化电路设计、又提高系统稳定性和可靠性的目的。
上传时间： 2013-12-22
上传用户：forzalife
