Slave+FIFO

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Slave+FIFO 热门资料

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异步FIFO结构，FPGA设计中FIFO结构的设计具体讲解

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一个同步FIFO，包括testbench，

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2013-12-30 182 Slave+FIFO

FIFO电路(first in，first out)，内部藏有１６ｂｉｔ×１６ｗｏｒｄ的Dual port RAM，依次读出已经写入的数据。因为不存在Address输入，所以请自行设计内藏的读写指针。由FIFO电路输出的EF信号(表示RAM...

2016-02-06 128 Slave+FIFO

2013-12-28 79 Slave+FIFO

FIFO的verilog实现，内附testbench和文档说明

2013-12-24 150 Slave+FIFO

同步FIFO功能，verilog语言描述，通过了modelsim 6.0 仿真，Quartue综合

2014-12-03 167 Slave+FIFO

使用FPGA的FIFO，状态机，乒乓操作等实现了异步UART。

2016-11-07 87 Slave+FIFO

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