利用v4fpga实现sdram ddr控制器设计,很详细的,很实用的资料
Sdram 技术资料
同步动态随机存取内存(synchronousdynamicrandom-accessmemory,简称SDRAM)是有一个同步接口的动态随机存取内存(DRAM)。通常DRAM是有一个异步接口的,这样它可以随时响应控制输入的变化。而SDRAM有一个同步接口,在响应控制输入前会等待一…
SDRAM控制IP核的VHDL语言源代码,需要的开发环境是QUARTUS II 6.0。
标准SDR SDRAM控制器参考设计_verilog_lattice\sdr_ctrl.v
基于FPGA的高速SDRAM控制器设计,采用流水线架构提升数据吞吐效率,支持多通道并发访问,符合JEDEC标准,适用于实时嵌入式系统开发。
SDRAM控制器的源代码打包下载,不错不错值得试试
Altera 官方提供的SDRAM控制器,verilog的
flash,ram,sdram读写程序和测试代码
5402CPU对外部扩展SDRAM的读取实验
三星SDRAM的verilog模型的完整源码
镁光用Verilog 编写的sdram的模型及测试代码,可以在没有开发板的情况下练习sdram的操作