SLAVE+FIFO

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基于Altera FPGA实现的SPI从机模块,采用Verilog HDL编写,具备标准SPI协议兼容性与高效时序控制。适用于嵌入式系统通信接口开发。

2026-02-02 1 SLAVE+FIFO

FIFO,vhdl实现,希望可以有帮助,大家加油。。。

2013-12-29 117 SLAVE+FIFO

fifo 应用,fifo空满标志的判断方法及思路

2025-06-20 3 SLAVE+FIFO