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介绍了一种10M/ 100M 以太网控制器的实现方法,该控制器以FIFO 作为帧缓存,通过程序设计实现10M/ 100M 自适应,设计中采用WS 接口,提高了设计的灵活行,可以实现与其他SOC 的互连[1 ] ,该设计采用VerilogHDL 硬件描述语言编程,基于ISE 开发环境,在Xilinx ...

📅 👤 liglechongchong
FPGA 100 10 以太网控制器

提出了一种基于CAN总线的分布式水下航行器控制器的设计方法，主要描述了其硬件总体设计方案和实现办法。控制器作为分布式控制系统的一个节点，与其他节点之间以CAN总线连接并形成网络，相互传输数据和控制命令，每个节点都有主控计算机，以实现计算任务的分散化。控制器以基于ARM架构的MCU为控制计算机，搭载隔...

📅 👤 Huge_Brother
总线 分布式 制器设计

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使用verilog实现基于fpga的sdram控制器.txt
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21ic ddr sdram控制器的fpga实现.htm
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说明.txt
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使用 virtex-4 fpga 器件实现ddr sdram控制器.pdf
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基于fpga的sdram控制器设计及应用.pdf
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