SDRAM+Flash

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sdram parameter SC_BL 突发长度 ; parameter SDR_BT 突发结束命令 parameter SDR_RCD RAS到CAS延迟 parameter SDR_CL CA...

2025-02-22 6 SDRAM+Flash

SDR_SDRAM源代码。在FPGA EP2C8Q208调试通过。

2025-06-01 7 SDRAM+Flash

涵盖SDRAM控制器设计与实现的完整技术栈,包含FIFO机制、时序控制及Verilog硬件描述语言应用,适合深入理解存储接口开发与系统级芯片设计。

2026-03-15 1 SDRAM+Flash