搜索：Real-time System
找到约 104 项符合「Real-time System」的查询结果
结果 104
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https://www.eeworm.com/dl/527/11904.html
通讯/手机编程
stbc_ofdm(time)
从时域分析比较了ofdm和stbc与ofdm结合的性能差别-from time-domain analysis and comparison of OFDM stbc OFDM combined wi
https://www.eeworm.com/dl/552/13579.html
ALTERA FPGA开发软件
Prime Time 1.20
用PrimeTime进行静态时序分析. §2.2 PrimeTime进行时序分析的流程 使用PrimeTime对一个电路设计进行静态时序分析,
https://www.eeworm.com/dl/552/13580.html
ALTERA FPGA开发软件
System Generator 9.10
System Generator 8.1。用户将很快发现新版本带来的全新感觉。新版本中大大增强了Block Dialog Boxes的功能，许多模块的参数选择功能也得到了加强。
https://www.eeworm.com/dl/571/20331.html
模拟电子
High-Speed Digital System Design
Introduce High-Speed Digital System Design.
https://www.eeworm.com/dl/OrCAD/doc/18824.html
教程资料
System will automatically delete the directory
System will automatically delete the directory
https://www.eeworm.com/dl/allegro/20125.html
allegro
VHDL,Verilog,System verilog比较
 
本文简单讨论并总结了VHDL、Verilog，System verilog 这三中语言的各自特点和区别As the number of enhancements to variousHardware Description Languages (HDLs) hasincreased over the past year, so too has the complexityof determining which language is best fora particular des ...
https://www.eeworm.com/dl/fpga/doc/18681.html
教程资料
Building a RISC System in an FPGA
Building a RISC System in an FPGA
https://www.eeworm.com/dl/571/20507.html
模拟电子
基于System Generator的数字下变频设计
Xilinx公司推出的DSP设计开发工具System Generator是在Matlab环境中进行建模，是DSP高层系统设计与Xilinx FPGA之间实现的“桥梁”。在分析了FPGA传统级设计方法的基础上，提出了基于System Generator的系统级设计新方法，并应用新方法设计验证了一套数字下变频系统，通过仿真和实验结果验证 ...