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教你用各种方法实现分频，实现良好的时序。个你的RTL开发增加经验...

📅 2017-08-07

在 MAX+PLUS II开发环境下采用 VHDL语言设计并实现了电表抄表器讨论了系统的四个组成模块的设计和 VHDL 的实现每个模块采用 RTL 级描述整体的生成采用图形输入法通过波形...

📅 2013-12-26

随着计算机网络与嵌入式控制技术的迅速发展，作为传统运输行业的铁路系统对此也有了新的要求，列车通信网络应运而生。经过多年的发展，国际电工委员会(IEC)为了规范列车通信网络，于1999年通过了IEC61...

📅 2013-07-18

《Delphi源代码分析》　　本书通过对Delphi内核（RTL）源代码进行分析，深入阐述了Delphi内核（RTL）的原理及其实现。全书从Nico Bendlin编写的著名最小化内核示例程序M...

📅 2014-01-10

44b0X开发板 CPU:S3C44B0X FLASH:HY29LV160BT 2M SDRAM:HY57V641620 8M 2 COM USB1.1 PDIUSBD12 NET RTL...

📅 2015-11-03

软件开发环境：ISE 7.1i 仿真环境：ModelSim SE 6.0 1. 这个实例实现通过ModelSim工具实现一个具有“百分秒，秒，分”计时功能的数字跑表； 2. 工程在proj...

📅 2016-10-04

软件开发环境：ISE 7.1i 仿真环境：ISE Simulator 1. 这个实例实现通过ISE Simulator工具实现一个具有两个方向共八个灯的交通灯控制器； 2. 工程在proj...

📅 2014-01-25

使用函数实现简单的八位处理器软件开发环境：ISE 7.1i 仿真环境：ISE Simulator 1. 这个实例实现通过ISE Simulator工具实现一个可以进行两个八位操作数四...

📅 2014-01-06

典型实例10.8 字符LCD接口的设计与实现软件开发环境：ISE 7.1i 硬件开发环境：红色飓风II代－Xilinx版 1. 本实例控制开发板上面的LCD的显示； 2. 工程在\p...

📅 2013-12-26

《Delphi源代码分析》本书通过对Delphi内核（RTL）源代码进行分析，深入阐述了Delphi内核（RTL）的原理及其实现。全书从Nico Bendlin编写的著名最小化内核示例程序Min...

📅 2013-12-21

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