RTC时钟模块
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查看全部 500 份 →本VHDL源代码由顶层模块、测频模块、驱动模块、计算模块、LCD显示模块、复位模块组成
本VHDL源代码由顶层模块、测频模块、驱动模块、计算模块、LCD显示模块、复位模块组成，能精确检测从1--100M频率，误差极小且恒定。
2015-10-18
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实时时钟模DS1302C51程序列子,输入: ucCurtime: 保存当前时间地址.
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2013-12-21
185
dos下时钟显示程序 dos下时钟显示程序 dos下时钟显示程序 dos下时钟显示程序
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2015-10-04
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本程序为模拟可校时的时钟程序；clk--时钟信号,rst--清零信号,set_en--校时 使能信号,faster--快进信号,slower--快退信号,hour--小时校时,min--分钟校 时
本程序为模拟可校时的时钟程序；clk--时钟信号,rst--清零信号,set_en--校时 使能信号,faster--快进信号,slower--快退信号,hour--小时校时,min--分钟校 时,（hh,hl,ml,mh,sh,sl）...
2013-12-06
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