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RAM-DAC

  • 本测试程序是针对TMS320LF2407 EVM的性能测试而设计开发的。程序运行时将按顺序对数据RAM空间、程序代码空间、片上异步串行通讯、ADC-DAC联合检测、双向数字I/O口、通用I/O和评估板

    本测试程序是针对TMS320LF2407 EVM的性能测试而设计开发的。程序运行时将按顺序对数据RAM空间、程序代码空间、片上异步串行通讯、ADC-DAC联合检测、双向数字I/O口、通用I/O和评估板LED、评估板并排手动开关分别进行检测。测试结果的正确或错误均有信息显示。

    标签: ADC-DAC 2407 TMS 320

    上传时间: 2014-02-04

    上传用户:klin3139

  • 2812的标准CMD文件【RAM和FLASH】.rar

    2812的标准CMD文件【RAM和FLASH】

    标签: FLASH 2812 CMD RAM

    上传时间: 2013-04-24

    上传用户:晴天666

  • 16bit音频过采样DAC的FPGA设计实现.rar

    基于∑-△噪声整形技术和过采样技术的数模转换器(DAC)可以可靠地把数字信号转换成为高精度的模拟信号。采用这一结构进行数模转换具有诸多优点,例如极低的失配噪声和高的可靠性,便于作为IP模块嵌入到其他芯片系统中等,更重要的是可以得到其他DAC结构所无法达到的精度和动态范围。在高精度测量、音频转换、汽车电子等领域有着广泛的应用价值。 由于非线性和不稳定性的存在,高阶∑-△调制器的设计与实现存在较大的难度。本设计综合大量文献中的经验原则和方法,首先阐述了∑-△调制器的一般原理,并讨论了一般结构调制器的设计过程,然后描述了稳定的高阶高精度调制器的设计流程。根据市场需求,设定了整个设计方案的性能指标,并据此设计了达到16bit精度和满量程输入范围的三阶128倍过采样调制器。 本设计采用∑-△结构,根据系统要求设计了量化器位数、调制器过采样比和阶数。在分析高阶单环路调制器稳定性的基础上,成功设计了六位量化三阶单环路调制器结构。在16比特的输入信号下,达到了90dB左右的信噪比。该设计已经在Cyclone系列FPGA器件下得到硬件实现和验证,并实现了实时音频验证。测试表明,该DAC模块输出信号的信噪比能满足16比特数据转换应用的分辨率要求,并具备良好的兼容性和通用性。 本设计可作为IP核广泛地在其他系统中进行复用,具有很强的应用性和一定的创新性。

    标签: FPGA bit DAC

    上传时间: 2013-07-10

    上传用户:chuandalong

  • 基于DSP和FPGA的运动控制卡的研究与开发

    随着微电子技术和电力电子技术的飞速发展,运动控制系统正朝着通用化、智能化、微型化的方向发展。目前,以数字信号处理器(DSP)和现场可编程门阵列(FPGA)为核心的运动控制卡已成为运动控制器的发展主流。它可方便地以插卡形式嵌入PC机,将PC机强大的信息处理能力和开放式特点与运动控制卡的运动控制能力相结合,具有信息处理能力强、开放程度高、运动控制方便、通用性好的特点。因此,本文通过对运动控制技术的深入研究,开发了一款以DSP和FPGA为主控单元、基于PCI总线的运动控制卡。 首先,设计了运动控制卡硬件电路,对控制卡的DSP和FPGA外围电路、PCI总线接口电路、模拟量输出电路、编码器信号采集电路、通用I/O接口电路等实现方法进行了详细讨论。 为提高控制卡的硬件集成度和可靠性,通过对FPGA的编程设计,在FPGA中实现了PCI总线目标设备接口控制器、双端口RAM、DDA精插补电路、DAC接口电路、编码器信号处理电路和数字I/O信号处理电路。 基于改进的数字PID控制器和前馈控制,设计开发了运动控制卡的位置闭环伺服控制器,并整定了控制器参数,获得良好的伺服控制特性。 最后,采用WinDriver开发了控制卡的驱动程序,并详细介绍了驱动程序的开发流程。

    标签: FPGA DSP 运动控制卡

    上传时间: 2013-08-01

    上传用户:00.00

  • 基于DSP和FPGA的运动控制技术的研究

    该课题通过对开放式数控技术的全面调研和对运动控制技术的深入研究,并针对国内运动控制技术的研究起步较晚的现状,结合激光雕刻领域的具体需要,紧跟当前运动控制技术研究的发展趋势,吸收了世界开放式数控技术和相关运动控制技术的最新成果,采纳了基于DSP和FPGA的方案,研制了一款比较新颖的、功能强大的、具有很大柔性的四轴多功能运动控制卡.该论文主要内容如下:首先,通过对制造业、开放式数控系统、运动控制卡等行业现状的全面调研,基于对运动系统控制技术的深入学习,在比较了几种常用的运动控制方案的基础上,确定了基于DSP和FPGA的运动控制设计方案,并规划了板卡的总体结构.其次,针对运动控制中的一些具体问题,如高速、高精度、运动平稳性、实时控制以及多轴联动等,在FPGA上设计了功能相互独立的四轴运动控制电路,仔细规划并定义了各个寄存器的具体功能,设计了功能完善的加/减速控制电路、变频分配电路、倍频分频电路和三个功能各异的计数器电路等,完全实现了S-曲线升降速运动、自动降速点运动、A/B相编码器倍频计数电路等特殊功能.再次,介绍了DSP在运动控制中的作用,合理规划了DSP指令的形成过程,并对DSP软件的具体实现进行了框架性的设计.然后,根据光电隔离原理设计了数字输入/输出电路;结合DAC原理设计了四路模拟输出电路;实现了PCI接口电路的设计;并针对常见的干扰现象,提出了有效的抗干扰措施.最后,利用运动控制卡强大的运动控制功能,并针对激光雕刻行业进行大幅图形扫描时需要实时处理大量的图形数据的特别需要,在板卡第四轴完全实现了激光控制功能,并基于FPGA内部的16KBit块RAM,开辟了大量数据区以便进行大幅图形的实时处理.

    标签: FPGA DSP 运动控制

    上传时间: 2013-06-09

    上传用户:youlongjian0

  • 可重构24bit音频过采样DAC的FPGA

    基于过采样和∑-△噪声整形技术的DAC能够可靠地把数字信号转换为高精度的模拟信号(大于等于16位)。采用这一架构进行数模转换具有诸多优点,例如极低的失配噪声和更高的可靠性,便于实现嵌入式集成等,最重要的是可以得到其他DAC结构所无法达到的精度和动态范围。在高精度测量,音频转换,汽车电子等领域有着广泛的应用价值。 本文采用∑-△结构以FPGA方式实现了一个具有高精度的数模转换器,在24比特的输入信号下,达到了约150dB的信噪比。作为一个灵活的音频DAC实现方案。该DAC可以对CD/DVD/HDCD/SACD等多种制式下的音频信号进行处理,接受并转换采样率为32/44.1/48/88.2/96/192kHz,字长为16/18/20/24比特的PCM数据,具备良好的兼容性和通用性。 由于非线性和不稳定性的存在,高阶∑-△调制器的设计与实现存在较大的难度。本文综合大量文献中的经验原则和方法,阐述了稳定的高阶高精度调制器的设计流程;并据此设计了达到24bit精度和满量程输入范围的的5阶128倍调制器。本文创新性地提出了∑-△调制器的一种高效率流水线实现结构。分析表明,与其他常见的∑-△调制器实现结构相比,本方案具有结构简单、运算单元少等优点;此外在同样信号采样率下,调制器所需的时钟频率大大降低。 文中的过采样滤波模块采用三级半带滤波器和一个可变CIC滤波器级联组成,可以达到最高128倍的过采样比,同时具有良好的通带和阻带特性。在半带滤波器的设计中采用了CSD编码,使结构得到了充分的简化。 本文提出的过采样DAC方案具有可重配置结构,让使用者能够方便地控制过采样比和调制器阶数。通过积分梳状滤波器的配置,能够获得32/64/128倍的不同过采样比,从而实现对于32~192kHz多种采样率输入的处理。在不同输入字长情况下,通过调制器的重构,则可以将调制器由高精度的5阶模式改变为功耗更低的3阶模式,满足不同分辨率信号输入时的不同精度要求。这是本文的另一创新之处。 目前,该过采样DAC已经在XilinxVirtexⅡ系列FPGA器件下得到硬件实现和验证。测试表明,对于从32kHz到192kHz的不同输入信号,该DAC模块输出1比特码流的带内信噪比均能满足24比特数据转换应用的分辨率要求。

    标签: FPGA bit DAC 24

    上传时间: 2013-07-08

    上传用户:从此走出阴霾

  • 基于FPGA的双口RAM在PC104与DSP通信中的研究与应用

    ·基于FPGA的双口RAM在PC104与DSP通信中的研究与应用

    标签: FPGA 104 DSP RAM

    上传时间: 2013-07-03

    上传用户:叶山豪

  • freescale k40/k60 12bit dac 例程

    freescale k40/k60 cortex m4 12bit dac 例程

    标签: freescale bit dac 40

    上传时间: 2013-05-22

    上传用户:luominghua

  • STM32F4-Discovery DMA-FLASH-RAM keil&iar例程

    STM32F4-Discovery DMA-FLASH-RAM keil&iar例程

    标签: DMA-FLASH-RAM Discovery keil STM

    上传时间: 2013-04-24

    上传用户:a3318966

  • 异步FIFO是用来适配不同异步FIFO采用了格雷(GRAY)变换技术和双端口RAM实现了不同时钟域之间的数据无损传输

    异步FIFO是用来适配不同时钟域之间的相位差和频率飘移的重要模块。本文设计的异步FIFO采用了格雷(GRAY)变换技术和双端口RAM实现了不同时钟域之间的数据无损传输。该结构利用了GRAY变换的特点,使得整个系统可靠性高和抗干扰能力强,系统可以工作在读写时钟频率漂移达到正负300PPM的恶劣环境。并且由于采用了模块化结构,使得系统具有良好的可扩充性。

    标签: FIFO GRAY RAM 适配

    上传时间: 2013-08-07

    上传用户:13817753084