Altium.Designer.14.0.9.build.30380+安装视频+破解
上传时间： 2013-05-31
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Multisim 10.0汉化破解版（含安装教程）
上传时间： 2013-04-15
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Multisim 12.0 汉化破解版
上传时间： 2013-07-03
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电感器设计工具集-27册-46.0M 变压器制造工艺流程图-10个-0.4M-pdf版.zip
上传时间： 2013-04-24
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电感器设计工具集-27册-46.0M 环型电源变压器计算步骤-43页-0.4M.ppt
上传时间： 2013-06-13
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电感器设计工具集-27册-46.0M 变压器设计大师-V2.0-3.1M.zip
上传时间： 2013-06-29
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bushound5.0完美版 USB 开发必备工具，完美破解版。安装即可使用无须注册，可以节约您保贵的时间。
上传时间： 2013-08-06
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电压源型PWM逆变器在当前的工业控制中应用越来越广泛，在其应用领域中，交流电动机的运动控制是其很重要的组成部分。在PWM逆变器的控制过程中，设置死区是为了避免逆变器的同一桥臂的两个功率开关器件发生直通短路。尽管死区时间很短，然而当开关频率很高或输出电压很低时，死区将使逆变器输出电压波形发生很大畸变，进而导致电动机的电流发生畸变，电机附加损耗增加，转矩脉动加大，最终导致系统的控制性能降低，甚至可能导致系统不稳定。为此，需要对逆变器的死区进行补偿。本文针对连续空间矢量调制提出了一种改进的减小零电流钳位和寄生电容影响的死区效应补偿方法；针对断续空间矢量调制提出了通过改变空间矢量作用时间，来改变驱动信号脉冲宽度的补偿方法，并对这两种方法进行了理论分析和仿真研究。 本文首先详细分析了死区时间对逆变器输出电压和电流的影响，以及功率开关器件寄生电容对输出电压的影响。其次对已提出的减小零电流钳位和寄生电容影响的死区效应补偿方法进行了理论分析，该方法先计算出补偿电压，再对由零电流钳位现象引起的补偿电压极性错误进行校正，极性校正的参考量为d轴补偿电压的幅值，然而补偿电压的大小随电流的变化而变化，因此该方法存在电压极性校正时参考量为变化量的缺点，而且该方法只适用于id=0的控制方式，适用性较差。针对这些问题，本文提出了改进的减小零电流钳位和寄生电容影响的补偿方法，改进后的方法是先对由零电流钳位现象引起的电流极性错误进行校正，然后再计算补偿电压的大小，电流极性校正时的参考量为三相电流极性函数转化到γ-坐标系的函数sγ的幅值，sγ的幅值与补偿电压大小无关为恒定值，而且适用于任何控制方式，适应性强。再次把改进的减小零电流钳位和寄生电容影响的死区效应补偿方法应用到PMSM矢量控制系统中，采用MATLAB和Pspice两种方法进行了仿真研究，仿真结果验证了补偿方法的有效性。对两种仿真结果的对比分析，表明PSpice模型能更好的模拟逆变器的非线性特性。 最后，文章分析了连续空间矢量调制和断续空间矢量调制的输出波形的区别和死区对两种波形影响的不同。针对DSP芯片TMS320LF2407A硬件产生的断续SVPWM波，提出了根据电压矢量和电流矢量的相位关系，通过改变空间矢量作用时间，来改变驱动信号脉冲宽度，对其进行死区补偿的方法。给出了基本空间矢量作用时间调整的实现方法，并建立了MATLAB仿真模型，进行仿真研究，仿真结果验证了补偿方法的正确性和有效性。
上传时间： 2013-06-04
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该系统是一款磁卡阅读存储器，根据用户要求解决了普通阅读器只能实时连接计算机，不能单独使用的问题。而且针对作为特殊用途的磁卡，要求三道磁道都记录数据，并且第三磁道记录格式与标准规定的记录格式不同时，系统配套的应用程序对其做了正确译码、显示。 @@ 整个系统包括单片机控制的阅读存储器硬件部分，和配套使用的计算机界面应用程序软件部分。其中硬件电路包括磁条译码芯片、外部存储器芯片、串口电平转换芯片等等，所有的工作过程都是由单片机控制。我们这里选用紫外线擦除的87C52单片机，电路使用的集成电路芯片都是采用SMT封装器件，极大缩小了读存器的体积，使用简单，携带方便。 @@ 磁条译码芯片采用的是中青科技有限公司出品的M3-230.LQ F/2F解码器集成电路。该IC实现了磁信号到电信号的转换。外部存储器则是使用的8K Bytes的24LC65集成芯片，扩展8片，总容量达到8×8K。 @@ MAXIM公司出品的MAX232实现了单片机TTL电平到RS232接口电平的转换，从而与计算机串口实现硬件连接。 @@ 计算机界面显示程序采用当今使用最广的面向对象编程语言Visual Basic 6.0版本(以后简称VB)，并且使用VB带有的串口通信控件MScomm，通过设置其属性，使其和下位机单片机协议保持一致，进而进行正确的串口通信。关于磁道上数据记录的译码，则是通过对每条磁道上数据记录进行多次实验，认真分析，进而得到了各条磁道各自的编码规则，按照其规则对其译码显示。这部分程序也是通过VB编程语言实现的。另外，计算机应用程序部分还实现了对下位机读存器的擦除控制。 @@关键词：磁卡，阅读存储器，单片机，串口通信，track3数据译码
上传时间： 2013-08-05
上传用户：黄华强
卷积码是广泛应用于卫星通信、无线通信等多种通信系统的信道编码方式。Viterbi算法是卷积码的最大似然译码算法，该算法译码性能好、速度快，并且硬件实现结构比较简单，是最佳的卷积码译码算法。随着可编程逻辑技术的不断发展，使用FPGA实现Viterbi译码器的设计方法逐渐成为主流。不同通信系统所选用的卷积码不同，因此设计可重配置的Viterbi译码器，使其能够满足多种通信系统的应用需求，具有很重要的现实意义。 本文设计了基于FPGA的高速Viterbi译码器。在对Viterbi译码算法深入研究的基础上，重点研究了Viterbi译码器核心组成模块的电路实现算法。本设计中分支度量计算模块采用只计算可能的分支度量值的方法，节省了资源；加比选模块使用全并行结构保证处理速度；幸存路径管理模块使用3指针偶算法的流水线结构，大大提高了译码速度。在Xilinx ISE8.2i环境下，用VHDL硬件描述语言编写程序，实现(2，1，7)卷积码的Viterbi译码器。在(2，1，7)卷积码译码器基础上，扩展了Viterbi译码器的通用性，使其能够对不同的卷积码译码。译码器根据不同的工作模式，可以对(2，1，7)、(2，1，9)、(3，1，7)和(3，1，9)四种广泛运用的卷积码译码，并且可以修改译码深度等改变译码器性能的参数。 本文用Simulink搭建编译码系统的通信链路，生成测试Viterbi译码器所需的软判决输入。使用ModelSim SE6.0对各种模式的译码器进行全面仿真验证，Xilinx ISE8.2i时序分析报告表明译码器布局布线后最高译码速度可达200MHz。在FPGA和DSP组成的硬件平台上进一步测试译码器，译码器运行稳定可靠。最后，使用Simulink产生的数据对本文设计的Viterbi译码器的译码性能进行了分析，仿真结果表明，在同等条件下，本文设计的Viterbi译码器与Simulink中的Viterbi译码器模块的译码性能相当。
上传时间： 2013-06-24
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