PLL锁相环
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期刊论文：基于Hilbert移相滤波的全数字锁相环
·论文摘要：提出了一种基于Hilbert 移相滤波实现的全数字锁相环，用于实现低频交流信号频率和相位的数字化测量。先将被测信号经过模数变换后输入到一对全数字的Hilbert 移相滤波器，得到幅值相等相位相差90°的两个信...
2024-08-04
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基于ADF4111的锁相环频率合成器设计
为得到性能优良、符合实际工程的锁相环频率合成器，提出了一种以ADI的仿真工具ADIsimPLL为基础，运用ADS（Advanced Design System 2009）软件的快速设计方法。采用此方法设计了频率输出为930~960 MHz的...
2013-12-16
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FPGA内全数字延时锁相环的设计.rar
现场可编程门阵列(FPGA)的发展已经有二十多年，从最初的1200门发展到了目前数百万门至上千万门的单片FPGA芯片。现在，FPGA已广泛地应用于通信、消费类电子和车用电子类等领域，但国内市场基本上是国外品牌的天下。 在高密度FPGA中，芯...
2013-06-10
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高频接收器和发射器的锁相环一
第一部分将重点介绍有关PLL的基本概念，同时描述基本PLL架构和工作原理，另外，我们还将举例说明PLL在通信系统中的用途。最后，我们将展示一种运用ADF4111频率合成器和VCO190-902T电压控制振荡器的实用PLL电路。
2025-12-14
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