- vii - 8.1.1 实验目的 315 8.1.2 实验设备 315 8.1.3 实验内容 315 8.1.4 实验原理 315 8.1.5 实验操作步骤 318 8.1.6 实验参考程序 319 8.1.7 练习题 321- vi - 6.4 USB 接口实验 266 6.4.1 实验目的 266 6.4.2 实验设备 267 6.4.3 实验内容 267 6.4.4 实验原理 267 6.4.5 实验操作步骤 270 6.4.6 实验参考程序 272 6.4.7 实验练习题 280 6.5 SPI接口通讯实验 281 6.5.1 实验目的 281 6.5.2 实验设备 281 6.5.3 实验内容 281 6.5.4 实验原理 281 6.5.5 实验操作步骤 285 6.5.6 实验参考程序 287 6.5.7 练习题 289 6.6 红外模块控制实验 289 6.6.1 实验目的 289 6.6.2 实验设备 289 6.6.3 实验内容 289 6.6.4 实验原理 289 6.6.5 实验操作步骤 291 6.6.6 实验参考程序 291 6.6.7 练习题 296 第七章 基础应用实验 296 7.1 A/D 转换实验 296 7.1.1 实验目的 296 7.1.2 实验设备 296 7.1.3 实验内容 296 7.1.4 实验原理 296 7.1.5 实验设计 298 7.1.6 实验操作步骤 299 7.1.7 实验参考程序 300 7.1.8 练习题 301 7.2 PWM步进电机控制实验 301 7.2.1 实验目的 301 7.2.2 实验设备 301 7.2.3 实验内容 301 7.2.4 实验原理 301 7.2.5 实验操作步骤 309 7.2.6 实验参考程序 311 7.2.7 练习题 313 第八章 高级应用实验 315 8.1 GPRS模块控制实验 315 - v - 5.2 5x4键盘控制实验 219 5.2.1 实验目的 219 5.2.2 实验设备 219 5.2.3 实验内容 219 5.2.4 实验原理 219 5.2.5 实验设计 221 5.2.6 实验操作步骤 222 5.2.7 实验参考程序 223 5.2.8 练习题 224 5.3 触摸屏控制实验 224 5.3.1 实验目的 224 5.3.2 实验设备 224 5.3.3 实验内容 224 5.3.4 实验原理 224 5.3.5 实验设计 231 5.3.6 实验操作步骤 231 5.3.7 实验参考程序 232 5.3.8 练习题 233 第六章 通信与接口实验 234 6.1 IIC 串行通信实验 234 6.1.1 实验目的 234 6.1.2 实验设备 234 6.1.3 实验内容 234 6.1.4 实验原理 234 6.1.5 实验设计 238 6.1.6 实验操作步骤 241 6.1.7 实验参考程序 243 6.1.8 练习题 245 6.2 以太网通讯实验 246 6.2.1 实验目的 246 6.2.2 实验设备 246 6.2.3 实验内容 246 6.2.4 实验原理 246 6.2.5 实验操作步骤 254 6.2.6 实验参考程序 257 6.2.7 练习题 259 6.3 音频接口 IIS 实验 260 6.3.1 实验目的 260 6.3.2 实验设备 260 6.3.3 实验内容 260 6.3.4 实验原理 260 6.3.5 实验步骤 263 6.3.6实验参考程序 264 6.3.7 练习题 266 - iv - 4.4 串口通信实验 170 4.4.1 实验目的 170 4.4.2 实验设备 170 4.4.3 实验内容 170 4.4.4 实验原理 170 4.4.5 实验操作步骤 176 4.4.6 实验参考程序 177 4.4.7 练习题 178 4.5 实时时钟实验 179 4.5.1 实验目的 179 4.5.2 实验设备 179 4.5.3 实验内容 179 4.5.4 实验原理 179 4.5.5 实验设计 181 4.5.6 实验操作步骤 182 4.5.7 实验参考程序 183 4.6.8 练习题 185 4.6 数码管显示实验 186 4.6.1 实验目的 186 4.6.2 实验设备 186 4.6.3 实验内容 186 4.6.4 实验原理 186 4.6.5 实验方法与操作步骤 188 4.6.6 实验参考程序 189 4.6.7 练习题 192 4.7 看门狗实验 193 4.7.1 实验目的 193 4.7.2 实验设备 193 4.7.3 实验内容 193 4.7.4 实验原理 193 4.7.5 实验设计 195 4.7.6 实验操作步骤 196 4.7.7 实验参考程序 197 4.7.8 实验练习题 199 第五章 人机接口实验 200 5.1 液晶显示实验 200 5.1.1 实验目的 200 5.1.2 实验设备 200 5.1.3 实验内容 200 5.1.4 实验原理 200 5.1.5 实验设计 211 5.1.6 实验操作步骤 213 5.1.7 实验参考程序 214 5.1.8 练习题 219 - ii - 3.1.1 实验目的 81 3.1.2 实验设备 81 3.1.3 实验内容 81 3.1.4 实验原理 81 3.1.5 实验操作步骤 83 3.1.6 实验参考程序 87 3.1.7 练习题 88 3.2 ARM汇编指令实验二 89 3.2.1 实验目的 89 3.2.2 实验设备 89 3.2.3 实验内容 89 3.2.4 实验原理 89 3.2.5 实验操作步骤 90 3.2.6 实验参考程序 91 3.2.7 练习题 94 3.3 Thumb 汇编指令实验 94 3.3.1 实验目的 94 3.3.2 实验设备 94 3.3.3 实验内容 94 3.3.4 实验原理 94 3.3.5 实验操作步骤 96 3.3.6 实验参考程序 96 3.3.7 练习题 99 3.4 ARM处理器工作模式实验 99 3.4.1 实验目的 99 3.4.2实验设备 99 3.4.3实验内容 99 3.4.4实验原理 99 3.4.5实验操作步骤 101 3.4.6实验参考程序 102 3.4.7练习题 104 3.5 C 语言程序实验一 104 3.5.1 实验目的 104 3.5.2 实验设备 104 3.5.3 实验内容 104 3.5.4 实验原理 104 3.5.5 实验操作步骤 106 3.5.6 实验参考程序 106 3.5.7 练习题 109 3.6 C 语言程序实验二 109 3.6.1 实验目的 109 3.6.2 实验设备 109 3.6.3 实验内容 109 3.6.4 实验原理 109 - iii - 3.6.5 实验操作步骤 111 3.6.6 实验参考程序 113 3.6.7 练习题 117 3.7 汇编与 C 语言的相互调用 117 3.7.1 实验目的 117 3.7.2 实验设备 117 3.7.3 实验内容 117 3.7.4 实验原理 117 3.7.5 实验操作步骤 118 3.7.6 实验参考程序 119 3.7.7 练习题 123 3.8 综合实验 123 3.8.1 实验目的 123 3.8.2 实验设备 123 3.8.3 实验内容 123 3.8.4 实验原理 123 3.8.5 实验操作步骤 124 3.8.6 参考程序 127 3.8.7 练习题 134 第四章 基本接口实验 135 4.1 存储器实验 135 4.1.1 实验目的 135 4.1.2 实验设备 135 4.1.3 实验内容 135 4.1.4 实验原理 135 4.1.5 实验操作步骤 149 4.1.6 实验参考程序 149 4.1.7 练习题 151 4.2 IO 口实验 151 4.2.1 实验目的 151 4.2.2 实验设备 152 4.2.3 实验内容 152 4.2.4 实验原理 152 4.2.5 实验操作步骤 159 4.2.6 实验参考程序 160 4.2.7 实验练习题 161 4.3 中断实验 161 4.3.1 实验目的 161 4.3.2 实验设备 161 4.3.3 实验内容 161 4.3.4 实验原理 162 4.3.5 实验操作步骤 165 4.3.6 实验参考程序 167 4.3.7 练习题 170 目 录 I 第一章 嵌入式系统开发与应用概述 1 1.1 嵌入式系统开发与应用 1 1.2 基于 ARM的嵌入式开发环境概述 3 1.2.1 交叉开发环境 3 1.2.2 模拟开发环境 4 1.2.3 评估电路板 5 1.2.4 嵌入式操作系统 5 1.3 各种 ARM开发工具简介 5 1.3.1 ARM的 SDT 6 1.3.2 ARM的ADS 7 1.3.3 Multi 2000 8 1.3.4 Embest IDE for ARM 11 1.3.5 OPENice32-A900仿真器 12 1.3.6 Multi-ICE 仿真器 12 1.4 如何学习基于 ARM嵌入式系统开发 13 1.5 本教程相关内容介绍 14 第二章 EMBEST ARM实验教学系统 17 2.1 教学系统介绍 17 2.1.1 Embest IDE 集成开发环境 17 2.1.2 Embest JTAG 仿真器 19 2.1.3 Flash 编程器 20 2.1.4 Embest EduKit-III开发板 21 2.1.5 各种连接线与电源适配器 23 2.2 教学系统安装 23 2.3 教学系统的硬件电路 27 2.3.1 概述 27 2.3.2 功能特点 27 2.3.3 原理说明 28 2.3.4 硬件结构 41 2.3.5 硬件资源分配 44 2.4 集成开发环境使用说明 51 2.4.1 Embest IDE 主框架窗口 51 2.4.2 工程管理 52 2.4.3 工程基本配置 55 2.4.4 工程的编译链接 71 2.4.5 加载调试 72 2.4.6 Flash编程工具 80 第三章 嵌入式软件开发基础实验 81 3.1 ARM汇编指令实验一 81
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心脏疾病一直是威胁人类生命健康的主要疾病之一。研究无创的心电信号检测设备来检测与评价心脏功能的状况，并研究心脏疾病的成因是生物医学电子学的重要研究课题之一。动态心电记录仪(Holter)是用于记录24小时长时间心电图的一种设备。研制高性能的动态心电记录、监护系统对于心血管疾病的诊断和治疗具有十分重要的意义。 Holter技术发展至今已有几十年历史，但目前的Holter仍存在许多不足之处：(1)许多Holter采用8位、16位单片机作为控制系统，运算能力有限，无法加入自动诊断功能：(2)数据存储采用固定焊接在板上的存储芯片，容量小，数据取出回放不方便；(3)大部分Holter还不能实现心电信号的实时远程传输，心电数据的分析以及分析报告的获取往往要滞后好几天时间，不利于心脏疾病的及早诊断及治疗。 针对这些不足，本文设计了一个基于ARM(一种32位嵌入式处理器)的动态心电记录仪。该记录仪具有运算功能强、能够实现心电信号实时远程网络传输的特点。为确保信息不会因网络传输故障而丢失，本系统同时还采用了便于携带的SD(Secure Digital Memory)闪存卡作为存储媒介，具有大容量数据存储的功能。本文设计的系统主要完成的任务有心电信号的采集、心电信号的放大滤波、心电信号的显示和心电信号的存储与传输。整个系统由一片ARM嵌入式微处理器控制，本系统中采用的嵌入式微处理器是三星的S3C44BOX。放大和滤波电路主要是对电极导联传来的心电信号进行放大和滤除干扰信号，以获取合适的信号大小并保证采集的心电信号的正确性。心电信号的显示是把心电信号实时地显示在Holter的液晶屏上，能使患者直观地观察到自己的心电信号情况。心电信号的存储采用了容量大、成本及功耗低并且体积小方便携带的SD卡来存储心电数据。心电数据的传输是通过以太网实现的，以太网可以实现快速、高正确率的传输。传输的数据由医院内的服务器接收，并且在服务器端对心电信号进行相应的显示和处理。为实现上述功能编写的系统软件包括Holter的Bootloader的设计、uCLINUX操作系统的移植、A/D转换程序、液晶屏的控制及菜单程序、SD卡FAT文件格式的数据存储和服务器端数据接收、波形显示程序。本系统经过一定的实验证明符合设计要求，具有体积小、成本低、使用方便的特点。
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数字图像处理，MATLAB的实现，包括图像的 基本算法实现。-Digital image processing
标签： MATLAB
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在电力现代化建设中，提高发电机发电效率是其中重要的一环，氢气作为导热性冷却介质广泛的应用于发电设备，作为冷却剂，它可以有效地提高其发电效率，但它又是一种易燃易爆气体，所以使氢气参数处于正常范围，保证发电机高效、安全正常工作就变得至关重要，因此对氢气参数进行实时监测有着重要的意义。 本论文研究和开发了基于ARM和CPLD的氢气参数监测系统，首先简要的分析了氢冷发电机系统对氢气参数进行监测的必要性以及当前电力系统氢气参数监控系统的发展情况。然后提出了一种利用无线通信手机短消息业务SMS、工控总线Modbus通信协议和RR485总线、SD卡海量存储等技术实现发电机系统多氢气参数的现场实时监测系统的设计方案。该方案以功能强大的ARM处理器作为系统的核心。采用高精度的16位AD转换芯片，并使用两种滤波算法的结合对信号进行数字滤波，满足系统对氢气参数采集精度的要求。同时系统结合CPLD技术，用于解决系统内微控器I/O口不足以及SD卡驱动的问题，本论文采用一片CPLD扩展I/O口，每一个扩展的I/O口都分配固定的地址，ARM微控器可以通过外部总线控制扩展I/O口的输出电平。SD卡(Secure Digital Memory Card)中文翻译为安全数码卡，是一种基于半导体快闪记忆器的新一代记忆设备，具有低成本，大容量的特点，系统的历史数据存储使用了SD卡作为存储介质，系统并没有直接使用ARM处理器读写SD卡，而是使用了拥有1270个逻辑单元的MAXⅡ1270 CPLD来驱动SD卡，在CPLD中使用VHDL语言设计了SD卡的总线协议，外部总线接口，SRAM的读写时序等，这样既可以提高微处理器SD卡的读写速度，增强微处理器程序的移植性，又可以简化微处理器读写SD卡的步骤并减少微处理器的负担。 本论文的无线数据传输采用GSM无线通信技术的SMS业务远传现场数据，设计了GSM模块的软件硬件，实现了报警等数据的无线传输，系统的有线传输采用了基于Modbus通信协议的RS485总线通信方式，采用这两种通信方式使系统的通信更加灵活、可靠。本论文最后分析了系统的不足并且提出了具体的改进方向。
上传时间： 2013-05-26
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随着现代计算机技术和互联网技术的飞速发展，嵌入式系统成为了当前信息行业最热门的焦点之一。ARM以其高性能低功耗的特点成为目前主流的32位嵌入式处理器而在数码产品中广泛使用，随着数码相机的普及，数码相框产品得到推广，数码相框通过一个液晶的屏幕显示数码照片而非纸质照片，数码相框比普通相框更灵活多变，也给现在日益使用的数码相片一个新的展示空间。在嵌入式操作系统方面，uC/OS—Ⅱ凭借其小内核、多任务、丰富的系统服务、容易使用以及源码公开等特点被嵌入式系统开发者广泛用在各种嵌入式设备开发中。uC/FS嵌入式文件系统由于稳定性，可移植性以及与uC/OS—Ⅱ内核的相兼容被广泛用在基于uC/OS—Ⅱ的嵌入式系统开发中。NAND Flash存储器由于其大容量数据存储、高速存取速度、易于擦除和重写、功耗小等特点被广泛应用于便携式电子设备的数据存储、嵌入式系统的程序存储载体中。 本论文的硬件工作平台是艾科公司研发的数码相框芯片方案ARK1600，该平台集成了嵌入式系统设计所需的相关硬件模块。本论文的主要设计目标是在该平台上实现NAND Flash存储设备驱动的系统级方案，即在ARK1600平台上通过构建uC/OS—Ⅱ操作系统以及uC/FS文件系统来实现NAND Flash设备驱动挂接。本论文是在Windows环境下通过ARM ADS实现代码的编译，通过Multi—ICE进行前期调试以及USB—Debug进行后期的系统整合调试。 本论文的主要研究工作具体涉及以下三个的方面：首先研究了ARM相关构架以及uC/OS—Ⅱ操作系统的特点，并在此基础上移植uC/OS—Ⅱ操作系统到ARK1600平台，分析ARK1600硬件体系结构的基础上详细分析了BootLoader的相关概念，并重点阐述了NAND BootLoader程序设计与实现过程；其次在文件系统方面，本论文成功移植uC/FS嵌入式文件系统到ARK1600平台，在移植的过程中采用了动态文件缓冲区算法提高了该文件系统的数据传输效率；最后重点讨论了NAND Flash驱动在ARK1600的实现，主要分析了NAND Flash的数据存储结构，并从物理层，逻辑层和文件系统接口层三个方面具体分析了NAND Flash驱动程序的实现，并在NAND Flash逻辑层驱动实现时通过采用坏块处理表算法实现了NAND的磨损均衡问题。
上传时间： 2013-07-31
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数字电视技术和超大规模深亚微米的系统级芯片设计技术是当前信息产业中最受关注的两个方向。它们的交叉就是数字电视应用中的一系列系统级芯片和超深亚微米专用集成电路。其中信道处理系统及其相关芯片更是集中了数字信号处理前向纠错编解码等数字电视传输的核心技术，成为设计和开发整个数字电视系统的关键之一。数字高清晰度电视(Digital HDTV)做为第三代电视标准，已成为当今世界高技术竞争的焦点，本文正是从这个交叉点上出发对DVB-H(Digital Video Broadcasting-Handheld)标准中所涉及的信道编码和调制部分进行了研究，重点分析了信道内编码部分的硬件优化实现。本项目完成了DVB-H传输系统信道编码的FPGA硬件设计和实现，系统所有FPGA硬件电路设计采用了Veillog HDL语言编写。同时对清华大学数字电视地面传输标准DMB-T(Terrestrial Digital Multimedia/TV Broadcasting)中的关键技术做了研究，与DVB标准中的相关技术做了对比。 本文首先对DVB．H以及COFDM的相关理论进行介绍和研究。然后针对DVB-H信道编码调制器中的部分核心算法的FPGA设计和实现进行了详细的研究工作，包括外编码、内编码(卷积删余)、内交织(包括比特交织和符号交织)、星座映射、帧形成、OFDM调制的部分设计等。相应地对DVB-H信道解码解调器中的部分算法的FPGA设计的研究工作做了描述，包括符号解交织和比特解交织。同时对清华大学数字电视地面传输标准DMB-T外接收机中频域和时域解交织模块的FPGA设计实现做了描述。 笔者在项目中完成的主要工作有： (1)与项目组成员合作制定系统框架，划分模块。 (2)对所负责的模块，包括外编码、内编码(卷积删余)、内交织(包括比特交织和符号交织)、星座映射、帧形成、OFDM调制的算法进行研究并加以优化，建立软件仿真模型，进行FPGA设计，仿真和实现。
上传时间： 2013-06-10
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低密度校验码（LDPC，Low Density Parity Check Code）是一种性能接近香农极限的信道编码，已被广泛地采用到各种无线通信领域标准中，包括我国的数字电视地面传输标准、欧洲第二代卫星数字视频广播标准（DVB-S2，Digital Video Broadcasting-Satellite 2）、IEEE 802.11n、IEEE 802.16e等。它是3G乃至将来4G通信系统中的核心技术之一。 当今LDPC码构造的主流方向有两个，分别是结合准循环（QC，Quasi Cyclic）移位结构的单次扩展构造和类似重复累积（RA，Repeat Accumulate）码构造。相应地，主要的LDPC码编码算法有基于生成矩阵的算法和基于迭代译码的算法。基于生成矩阵的编码算法吞吐量高，但是需要较多的寄存器和ROM资源；基于迭代译码的编码算法实现简单，但是吞吐量不高，且不容易构造高性能的好码。 本文在研究了上述几种码构造和编码算法之后，结合编译码器综合实现的复杂度考虑，提出了一种切实可行的基于二次扩展（Dex，Duplex Expansion）的QC-LDPC码构造方法，以实现高吞吐量的LDPC码收发端；并且充分利用该类码校验矩阵准循环移位结构的特点，结合RU算法，提出了一种新编码器的设计方案。 基于二次扩展的QC-LDPC码构造方法，是通过对母矩阵先后进行乱序扩展（Pex，Permutation Expansion）和循环移位扩展（CSEx，Cyclic Shift Expansion）实现的。在此基础上，为了实现可变码长、可变码率，一般编译码器需同时支持多个乱序扩展和循环移位扩展的扩展因子。本文所述二次扩展构造方法的特点在于，固定循环移位扩展的扩展因子大小不变，支持多个乱序扩展的扩展因子，使得译码器结构得以精简；构造得到的码字具有近似规则码的结构，便于硬件实现；（伪）随机生成的循环移位系数能够提高码字的误码性能，是对硬件实现和误码性能的一种折中。 新编码器在很大程度上考虑了资源的复用，使得实现复杂度近似与码长成正比。考虑到吞吐量的要求，新编码器结构完全抛弃了RU算法中串行的前向替换（FS，Forward Substitution）模块，同时简化了流水线结构，由原先RU算法的6级降低为4级；为了缩短编码延时，设计时安排每一级流水线计算所需的时钟数大致相同。 这种码字构造和编码联合设计方案具有以下优势：相比RU算法，新方案对可变码长、可变码率的支持更灵活，吞吐量也更大；相比基于生成矩阵的编码算法，新方案节省了50％以上的寄存器和ROM资源，单位资源下的吞吐量更大；相比类似重复累积码结构的基于迭代译码的编码算法，新方案使高性能LDPC码的构造更为方便。以上结果都在Xilinx Virtex II pro 70 FPGA上得到验证。 通过在实验板上实测表明，上述基于二次扩展的QC-LDPC码构造和相应的编码方案能够实现高吞吐量LDPC码收发端，在实际应用中具有很高的价值。 目前，LDPC码正向着非规则、自适应、信源信道及调制联合编码方向发展。跨层联合编码的构造方法，及其对应的编码算法，也必将成为信道编码理论未来的研究重点。
上传时间： 2013-07-26
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LAMOST(Large Sky Area Multi-Obiect Fiber Spectroscopy Telescope，大天区面积多目标光纤光谱天文望远镜)需要对焦而上的4 000个光纤定位单元进行精确定位，一个光纤定位单元需要两个步进电机来驱动，即需要对8 000个电机进行驱动控制。如何对这8 000个电机进行有效的控制，是本文主要的研究内容。 本义引入EDA(Electronic Design Automation)，技术，以FPGA和CAN总线为硬件载体来进行设计。FPGA相比较于DSP，单片机而言，具有10管脚多，资源丰富，使用灵活等优点，可以存片内集成多个电机的摔制，这样对于提高系统的集成度，节约成本无疑有着很大的帮助。 在电机的控制当中，其失步和过冲会直接影响到系统的精度，所以需要对电机脉冲频率加以控制，对于在平稳状态下能正常工作的电机，失步往往发生在启动停止等脉冲频率突然发生改变的时刻。具体实现方法是通过实验找出一条理想的加减速曲线，再将曲线离散化，并把离散化后的加减速分频系数存储在FPGA片内ROM里而，当电机运行到对应的步数时，取出分频系数来获取对应的运行频率。 在LAMOST观测中，光纤定位单元的零位是个很重要的基准，在每次观测之前，电机都要回零，理论上电气零位和机械零位在同一点上，如果电气检测到达零位则认为已经到达机械零位位置。但是实际中由于装配等一些原因，可能会出现零位短路和零位断路的情况。零位断路是指电机处于机械零位，但是电气不能检测到；零位短路是指电机不在机械零位，但是电气已经检测到处于零位。这两种情况会造成越界和机械零位一直被挤压的后果，有可能会损坏光纤定位单元，为了防止这些情况出现，软件程序中加入了计数器，从而从有效地保护了光纤定位单元，同时将这些状况向上反馈，以便维护和检修。 在本文完成之时，能够控制驱动336个光纤定位单元的小系统已经在北京天文台兴隆观测站实际投入运行，并于2007年5月28日获得首条光谱，取得了不错的效果。
上传时间： 2013-04-24
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在传统的电力电子电路中，DC/DC变换器通常采用模拟电路实现电压或电流的控制。数字控制与模拟控制相比，有着显著的优点，数字控制可以实现复杂的控制策略，同时大大提高系统的可靠性和灵活性，并易于实现系统的智能化。但目前数字控制基本上限于电力传动领域，DC/DC变换器由于其开关频率较高，一般其外围功能由DSP或微处理器完成，而控制的核心，如PWM发生等大多采用专用控制芯片实现。FPGA由于其快速性、灵活性及保密性等优点，近年来在数字控制领域受到越来越多的关注。基于FPGA的DC/DC变换器是电力电子领域重要的研究方向之一。本文研究了同步Buck变换器的建模、设计及仿真，采用Xinlix的VIRTEX-Ⅱ PRO FPGA开发板实现了Buck变换器的全数字控制。 论文首先从Buck变换器的理论分析入手，根据它的物理特性，研究了该变换器的状态空间平均模型和小信号分析。为了获得高性能的开关电源，提出并分析了混杂模型设计方案，然后进行了控制器设计。并采用MATLAB/SIMULINK建立了同步Buck电路的仿真模型，并进行仿真研究。浮点仿真的运算精度与溢出问题，影响了仿真的精度。为了克服这些不足，作者采用了定点仿真方法，得到了满意的仿真结果。论文还着重论述了开关电源的数字控制器部分，数字控制器一般由三个主要功能模块组成：模数转换器、数字脉宽调制器(Digital PulseWidth Modulation：DPWM)和数字补偿器。文中重点研究了DPWM和数字补偿器，阐述了目前高频数字控制变换器中存在的主要问题，特别是高频状态下DPWM分辨率较低，影响控制精度，甚至引起极限环(Limit Cycling)现象，对DPWM分辨率的提高与系统硬件工作频率之间的矛盾、DPWM分辨率与A/D分辨率之间的关系等问题作了全面深入的分析。论文提出了一种新的提高DPWM分辨率的方法，该方法在不提高系统硬件频率的前提下，采用软件使DPWM的分辨率大大提高。作者还设计了两种数字补偿器，并进行了分析比较，选择了合适的补偿算法，达到了改善系统性能的目的。 设计完成后，作者使用ISE 9.1i软件进行了FPGA实现的前、后仿真，验证了所提出理论及控制算法的正确性。作者完成了Buck电路的硬件制作及基于FPGA的软件设计，采用32MHz的硬件晶振实现了11-bit的DPWM分辨率，开关频率达到1MHz，得到了满意的系统性能，论文最后给出了仿真和实验结果。
上传时间： 2013-07-23
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光纤水听器自问世以来，在巨大的军事价值和民用价值推动下得到了迅速发展，已逐渐从实验室研究阶段走向工程应用。同时随着光纤水听器的不断发展，对水声信号的检测技术以及数字处理能力也提出了新的要求。论文在此背景下开展了一系列研究工作，并提出了利用FPGA(Field ProgrammableGate Array，现场可编程门阵列)实现光纤3×3耦合器解调算法的新思路。 目前干涉型光纤水听器的解调一般采用PGC(Phase Generated Carrier，相位生成载波技术)技术和基于3×3光纤耦合器干涉的解调技术。PGC技术在解调过程中引入了载波信号，它对采样率，激光器等的要求都较高，因此我们把目光投向3×3耦合器解调技术，文中对其解调原理进行了阐述，对采样率的确定进行了讨论，并对3×3耦合器三路输出不对称的情况进行了分析，最后在本文的结论部分提出了基于3×3耦合器解调的改良方案。 目前，光纤信号数字化解调的硬件实现采用DSP(Digital Signal Process，可编程数字信号处理器)信号处理机，与之相比，FPGA解调具有速度快、资源占用少、易于扩展等优势。本文对FPGA与DSP、ASIC(application-specificintegrated circuit，专用集成电路)实现方案进行了对比，分析了适合利用FPGA实现的算法所应具备的特征；介绍了3×3耦合器解调算法中各个模块的设计情况；分析了系统的工作情况，硬件的构造及芯片的选择，最后验证了利用FPGA可以实现3×3耦合器解调算法。
上传时间： 2013-07-03
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