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共 1,850 篇文章
MHZ 相关的电子技术资料，包括技术文档、应用笔记、电路设计、代码示例等，共 1850 篇文章，持续更新中。
DS18B20温度计C程序
DS18B20温度计C程序 OSC 11.0592MHZ 显示：Temp:12.34。C on 11_22 12:34:56 有报警按键开关 报警开关显示
一种低速可编程的声码器设计与实现
· 摘要： 为增强数字语音通信的安全性,提高传输带宽的利用率,基于低速率SELP算法,设计了一种具有可编程、高并行度、可重构、安全性等特点的声码器.采用四级ALU单元、可变长VLIW专用指令集等设计,优化了复杂度高的功能模块,显著提高指令级并行度.仿真结果表明,该声码器在20MHz主频下完成0.6kbps的SELP算法的平均功耗为200mW,完成编解码的运算复杂度为12.5M
基于C6416的匀速直线运动的模糊图像恢复
·摘要： 为解决相机与景物之间由于相对运动而造成的图像模糊问题.提出在定点DSP C6416上,通过优化维纳滤波算法来实现模糊图像的实时恢复.提出基于实数的一维维纳滤波优化算法.给出该算法与其他常规维纳滤波算法的实验结果和对比评价.实验结果显示:在主频600MHZ的DSP C6416实验平台上,对512×512 8位灰度测试图片先进行模糊处理,再通过该优化算法恢复.速度达到58ms每帧
基于DSP的高精度三角波测量仪设计与实现
· 摘要： 设计了一种高精度、数字化的三角波测量仪器,能对(0～5)MHz的任意周期的信号进行频率、幅值、斜率测量.TMS320LF2407数字信号处理器作为主处理器,用前置电路对待测信号做信号变换处理,根据实际被测信号的频率范围,采用等效采样的方法对被测信号进行等周期采样.在信号处理上,提出了用最小二乘法进行曲线拟合的方法对采样数据进行处理.使信号能精确地得到复现.确保测量
基于单片DSP的16通道全双工G.723.1编解码系统
·摘要： 介绍了TMS320C6201数字信号处理器和ITU-T G.723.1与音压缩标准.分析了以C6201实现多通道声码器的设计要点,设计了一个用于IP电话系统的多通道实时语音编解码子系统.该系统实现了ITUG.7∞.1包括附录A在内的全部功能,通过了ITU的所有测试矢量.在一片主频为200MHz的C6201上,可以全双工实时处理16路话音.
一种基于内插法符号同步电路的设计
· 摘要： 提出了一种新的符号同步电路结构,采用立方插值和O&M定时误差检测相结合的算法实现符号定时同步,并通过Altera DSP Builder完成该电路的设计、仿真和分析,将设计用Altera Stratix Ⅱ FPGA实现,应用在实际的接收机中,证明其能纠正1﹪的定时误差,工作时钟频率最高可达到130MHz.
宽频带无源积分器的设计和实验
为获得宽频带的无源阻容（RC）积分器，建立了考虑杂散参数的等效电路并进行了电路仿真。结果表明无源RC积分器的频响上限由杂散参数决定。对于相同结构的积分器，当增大RC积分常数，会使杂散参数的影响加剧，导致积分器的高频响变差。使用同轴结构可以减小电容的杂散电感，提高积分器的带宽。对制作的RC常数为10μs的同轴式积分器进行了频响实验。实验结果表明：在偏差小于5％的范围内，同轴式积分器带宽为50 kHz
针对H．264去块滤波的实用结构设计
·摘 要:为了提高H．264去块滤波的性能，提出了一种实用的环路滤波设计结构．使用优化的滤波顺序，执行一个宏块的滤波运算只需要252个周期，待滤波数据缓冲从16×16宏块大小降低为4×4块大小．利用数据重用策略，滤波中间数据的存储空间从16×16宏块减小到4个4×4块．使用优化的流水设计，有效降低了去块滤波对总线的数据访问．使用0．18μm工艺，100MHz下综合只需要14．2×10^3门．与以前
移动通信实验指导书
·详细说明：移动通信实验指导书 第一章 移动通信实验系统概述 第二章 语音压缩编码 第三章 信道编码试验 第四章 调制解调实验 第五章 系统实验 第六章 信道复用、信道仿真与均衡实验 第七章 900MHz GSM 手机实验
直接数字频率合成器的研究
本文介绍了直接数字频率合成器(DDS)的工作原理及基本结构，在此基础上推导了它的理想频谱，分析了DDS杂散的来源及抑制杂散的常用方法；重点研究了DDS中累加器和波形存储表的设计。针对DDS输入数据刷新率低的特点，双层累加器采用了32位由“流水时序”信号控制的改进的流水线结构，减少了与流水线级数相关的移位寄存器数量；各级流水线中的加法器采用组内、组间超前进位的方式提高了速度；引入相位累加器最低位修正
自制25MHz频率计数器.pdf
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RFID系统中识读器的设计与研究
· 摘要： 本文设计了基于先进的DSP技术、能在13.56MHz、868/915MHz、2.4GHz多个频段识别电子标签的RFID识读器的硬件结构.介绍了识读器的功能、组成及基本原理.基于模块化设计,提出了识读器硬件设计方案,以及采用的关键技术.
AT32UC3B0256说明书，完整版
32-bit AVR®
Microcontroller
AT32UC3B0512
AT32UC3B0256
AT32UC3B0128
AT32UC3B064
AT32UC3B1512
AT32UC3B1256
AT32UC3B1128
AT32UC3B164
Features
• High Performance, Low Power AVR®32 UC 32-Bit M
基于FPGA的高速数字分路算法的研究
基于均匀DFT滤波器组的数字分路算法是一种有效实现多载波信号频分分路的技术。近年来，随着微电子技术的发展和FPGA日益广泛的应用，基于FPGA实现数字分路算法已经成为一个备受关注的课题。然而在时钟频率较高情况下的数字分路技术的实现依然是一个难题。
本文在深入研究数字分路算法的两种实现结构(多相滤波结构和加权叠接-相加结构)的基础上，完成了一组32路载波信号数字分路算法的多相滤波结构和加权叠
一种用于浮点DSP的流水线结构DMA设计
· 摘要： 本文提出了一种用于32位浮点DSP处理器的改进型DMA结构.采用两级数据流水线结构,外设与内部存储器的数据传输速率比原来提高了一倍.使用verilog HDL语言对其进行编码和仿真,仿真结果表明工作频率达到250MHz以上,满足设计要求.
UHFASKFSK发射器T5750的原理及应用
T5750是ATMEL公司推出的单片UHFASKFSK发射器芯片,它内含发射功率放大器、晶体振荡器、压控振荡器、相频检波器、分频器、充电泵等电路.当T5750在868～928Mhz范围内工作时,其输出
增加ADC603的输入范围
The ADC603 is a 10MHz, 12-bit analog-to-digital converter<BR>with a ±1.25V input range. Many applica
ISD1700 语音芯片程序
ISD1700 -89C51开发试验板 ，51 单片机源程序（ 12MHz ）
基于NRF905的无线串口通信系统
nRF905是挪威Nordic VLSI公司推出的单片射频收发器，工作电压为1.9～3.6V，32引脚QFN封装(5×5mm)，工作于433/868/915MHz三个ISM(工业、科学和医学)频道，频道之间的转换时间小于650us。nRF905由频率合成器、接收解调器、功率放大器、晶体振荡器和调制器组成，不需外加声表滤波器， ShockBurstTM工作模式，自动处理字头和CRC(循环冗余码校验)
nrf905应用电路图
nRF905是挪威Nordic VLSI公司推出的单片射频收发器，工作电压为1.9～3.6V，32引脚QFN封装(5×5mm)，工作于433/868/915MHz三个ISM(工业、科学和医学)频道，频道之间的转换时间小于650us。