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高速串并转换器的设计是FPGA 设计的一个重要方面,传统设计方法由于采用FPGA 的内部逻辑资源来实现,从而限制了串并转换的速度。该研究以网络交换调度系统的FGPA 验证平台中多路高速串并转换器的设计为例,详细阐述了1 :8DDR 模式下高...

2013-11-03 69 K路归并

高速串并转换器的设计是FPGA 设计的一个重要方面,传统设计方法由于采用FPGA 的内部逻辑资源来实现,从而限制了串并转换的速度。该研究以网络交换调度系统的FGPA 验证平台中多路高速串并转换器的设计为例,详细阐述了1 :8DDR 模式下高...

2013-11-17 111 K路归并

本文针对工程实践的需要,设计了一种基于无线传输方式的多路信号并行采集系统RFDAQ-Ⅱ。RFDAQ-Ⅱ由一个数据接收单元和若干个并行数据采集单元组成,数据采集单元与接收单元之间通过无线的方式进

2024-02-13 3 K路归并

针对求解大型线性方程组,利用改进后的MGS方法和分治策略,给出了一种求解任意相容性线性方程组通解或不相容性线性方程组最小二乘解通解的并行数值方法,分析了该方法的复杂性和数值稳定性,探讨其基于MI

2024-02-25 6 K路归并