Verilog sd卡 IP核
使用Verilog进行开发的IP核,包括了FIFO以及与sd卡进行交互的模块...
使用Verilog进行开发的IP核,包括了FIFO以及与sd卡进行交互的模块...
quartus II 的SDRAM控制器IP,可用于图片缓存等...
ALTERA_SRAM_IP 核,包括verilog文件,tcl文件以及pdf...
可以用来学习8051IP核设计,掌握8051的开发,以及SOC的设计...
IP核生成器生成ip后有两个文件对我们比较有用,假设生成了一个asyn_fifo的核,则asyn_fifo.veo给出了例化该核方式(或者在Edit->Language Template->...