altera单时钟和双时钟fifo IP核用户向导
altera单时钟和双时钟fifo IP核用户向导,描述了该IP核各个输入和输出端口的含义以及使用方法和注意事项...
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基于CPLD/FPGA的SPI控制的IP核的实现spi_master...
IP地址将不同的物理地址统一起来,从而将物理地址隐藏起来,上层软件使用IP地址标识结点。但是,两台计算机只有在知道彼此的物理地址时才能进行通信。 IP数据包常通过Ethernet发送。Ether...
pic18f66j60单片机tcp/ip协议中的dns协议程序...
pic18f66j60单片机tcp/ip协议中的http协议程序...
该文档为FPGA_ASIC-NiosSoC系统中的BCH编解码IP核的设计讲解文档,是一份很不错的参考资料,具有较高参考价值,感兴趣的可以下载看看………………...
又是一个ucos很好的嵌入式IP源程序,快来下啊...
AVR IP core writen in VHDL. It is beta version, working even with AVR studio...
VERILOG VERSION PIC16C57 是一个用于FPGA模拟PIC16C57的IP核,有帮助文件,介绍了如何测试使用这个IP核。用VERILOG语言编写的。...
课程设计—IP分片重装模块设计实现...